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参数资料
| 型号： | MAX11008EVKIT+ |
| 厂商： | Maxim Integrated |
| 文件页数： | 63/67页 |
| 文件大小： | 0K |
| 描述： | KIT EVAL FOR MAX11008 BIAS CTLR |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 1 |
| 类型： | 偏压控制器 |
| 适用于相关产品： | MAX11008 |
| 已供物品： | 板，模块 |
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Dual RF LDMOS Bias Controller with
Nonvolatile Memory
Bypass the AV DD supply with a 0.1μF capacitor to
AGND, and place the capacitor as physically close as
possible to the AV DD input. Bypass the DV DD supply
with a 0.1μF capacitor to DGND, and place the capacitor
Table 22. Load DAC Register
as physically close as possible to the DV DD input. If the
power supply is very noisy, connect a 10 ? resistor in
series with the supply input to improve power-supply fil-
tering.
DATA BITS
D[15:2]
D1
D0
BIT NAME
Unused
LDDACCH2
LDDACCH1
RESET STATE
X
NA
NA
FUNCTION
Unused bits.
Channel 2 load DAC bit. Set to 1 to transfer DAC2 input register contents to
DAC2 output register.
Channel 1 load DAC bit. Set to 1 to transfer DAC1 input register contents to
DAC1 output register.
X = Don’t care.
NA = Not applicable.
Table 23. Message Register
DATA BITS
D[15:8]
D[7:0]
BIT NAME
MSGL[7:0]
MSGA[7:0]
RESET STATE
0000 0000
0000 0000
FUNCTION
Message length bits. Specifies the length of the message to be read from
the EEPROM in words. The actual length read is MSGL + 1.
Message address bits. Specifies the starting address of the message to be
read from the EEPROM.
Table 24. FIFO Read Register
DATA BITS
D[15:12]
D[11:0]
BIT NAME
DATA[15:12]/
TAG[3:0]
DATA[11:0]
RESET STATE
0000
0000 0000 0000
FUNCTION
Message mode data bits/LUT streaming mode data bits/ADC channel tag
bits. See Table 24a.
Message data bits/ADC data bits.
AGND TRACE
10mils
10mils
Figure 23. Recommended DXP_ and DXN_ PCB Trace Layout
DXP_ TRACE
DXN_ TRACE
AGND TRACE
10mils
10mils
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相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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