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参数资料
| 型号： | MAX3421EETJ+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 14/28页 |
| 文件大小： | 0K |
| 描述： | IC USB PERIPH/HOST CNTRL 32TQFN |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 60 |
| 控制器类型： | USB 外设控制器 |
| 接口： | USB/串行 |
| 电源电压： | 3 V ~ 3.6 V |
| 电流 - 电源： | 15mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-WFQFN 裸露焊盘 |
| 供应商设备封装： | 32-TQFN-EP（5x5） |
| 包装： | 托盘 |
| 产品目录页面： | 1407 (CN2011-ZH PDF) |
| 配用： | MAX3421EVKIT-1+-ND - EVAL KIT FOR MAX3421E |
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MAX3421E
USB Peripheral/Host Controller
with SPI Interface
21
Maxim Integrated
1) The SPI master sets the clock to its inactive state.
While
SS is high, the master can drive the MOSI pin
to any value.
2) The SPI master selects the MAX3421E by driving
SS low and placing the first data bit (MSB) to write
on the MOSI input.
3) The SPI master turns on its output driver and clocks
the command byte into the MAX3421E on the rising
edges of the SCLK it supplies. The SPI master
changes its MOSI data on the falling edges of SCLK.
4) After eight clock cycles, the master can drive
SS
high to deselect the MAX3421E.
5) To write SPI data, the SPI master keeps its output
driver on and clocks subsequent bytes into the
MOSI pin. To read SPI data, after the eighth clock
cycle the SPI master tri-states its output driver and
begins clocking in data bytes from the MOSI pin.
6) The SPI master terminates the SPI cycle by return-
ing
SS high.
Figures 10 and 11 show timing diagrams for full- and
half-duplex operation.
USB Serial-Interface Engine
The serial-interface engine (SIE) does most of the
detailed work required by USB protocol:
SS
MISO
MOSI
SCLK
SPI MODE 0,0 (CPOL = 0, CPHA = 0)
SUSPIRQ
URESIRQ
SUDAVIRQ
IN3BAVIRQ
IN2BAVIRQ
REG4
REG3
REG2
REG1
REG0
0
DIR
ACKSTAT
OUT1DAVIRQ OUT0DAVIRQ
IN0BAVIRQ
X
Figure 17. SPI Port in Full-Duplex Mode (Peripheral Mode)
SS
MISO
MOSI
SCLK
SPI MODE 0,0 (CPOL = 0, CPHA = 0)
HXFRDNIRQ
FRAMEIRQ
CONNIRQ
SUSDNIRQ
SNDBAVIRQ
REG4
REG3
REG2
REG1
REG0
0
DIR
ACKSTAT*
RCVDAVIRQ
RSMREQIRQ BUSEVENTIRQ
X
*ACKSTAT BIT NOT USED
Figure 18. SPI Port in Full-Duplex Mode (Host Mode)
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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