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参数资料
| 型号： | MB90822PFV |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 24 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 0.50 MM PITCH, PLASTIC, LQFP-80 |
| 文件页数： | 21/100页 |
| 文件大小： | 1414K |
| 代理商： | MB90822PFV |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页当前第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页
MB90820 Series
27
(Continued)
Meaning of abbreviations used for reading and writing
R/W: Read and write enabled
R
: Read-only
W
: Write-only
Explanation of initial values
0
: The bit is initialized to “0”.
1
: The bit is initialized to “1”.
X
: The initial value of the bit is undefined.
Address
Abbrevia-
tion
Register
Byte ac-
cess
Word
access
Resource name
Initial
value
0000C0H
PWCSL0
PWC control status register
ch0
R/W
PWC timer (ch0)
00000000 B
0000C1H
PWCSH0
R, R/W R, R/W
0 0 0 0 0 0 0 0 B
0000C2H
PWC0
PWC data buffer register ch0
R/W
XXXXXXXXB
0000C3H
XXXXXXXXB
0000C4H
DIV0
Divide ratio control register
ch0
R/W
XXXXXX00B
0000C5H
ADER0
A/D input enable register 0
R/W
Port 6, A/D
1 1 1 1 1 1 1 1 B
0000C6H
ADCS0
A/D control status register 0
R/W
8/10-bit A/D converter
000XXXX0B
0000C7H
ADCS1
A/D control status register 1
W, R/W W, R/W
0 0 0 0 0 0 0 X B
0000C8H
ADCR0
A/D data register 0
R
XXXXXXXXB
0000C9H
ADCR1
A/D data register 1
R
XXXXXXXXB
0000CAH
ADSR0
A/D setting register 0
R/W
0 0 0 0 0 0 0 0 B
0000CBH
ADSR1
A/D setting register 1
R/W
0 0 0 0 0 0 0 0 B
0000CCH
DAT0
D/A data register 0
R/W
8-bit D/A converter
XXXXXXXXB
0000CDH
DAT1
D/A data register 1
R/W
XXXXXXXXB
0000CEH
DACR0
D/A control register 0
R/W
XXXXXXX0B
0000CFH
DACR1
D/A control register 1
R/W
XXXXXXX0B
0000D0H
ADER1
A/D input enable register 1
R/W
Port 7, A/D
1 1 1 1 1 1 1 1 B
0000D1Hto
0000EFH
Prohibited area
0000F0H to
0000FFH
External area
001FF0H
PADRL0
Program address detection
register 0 (lower)
R/W
Address match
detection
XXXXXXXXB
001FF1H
PADRM0
Program address detection
register 0 (middle)
R/W
XXXXXXXXB
001FF2H
PADRH0
Program address detection
register 0 (higher)
R/W
XXXXXXXXB
001FF3H
PADRL1
Program address detection
register 1 (lower)
R/W
XXXXXXXXB
001FF4H
PADRM1
Program address detection
register 1 (middle)
R/W
XXXXXXXXB
001FF5H
PADRH1
Program address detection
register 1 (higher)
R/W
XXXXXXXXB
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PDF描述 |
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