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参数资料
| 型号： | MB95F262HWQN-G-SNE1 |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, MICROCONTROLLER, PQCC32 |
| 封装： | 5 X 5 MM, 0.80 MM HEIGHT, 0.50 MM PITCH, PLASTIC, QFN-32 |
| 文件页数： | 52/92页 |
| 文件大小： | 3535K |
| 代理商： | MB95F262HWQN-G-SNE1 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页当前第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页
MB95260H/270H/280H Series
56
DS07–12627–5E
FCH
(main oscillation)
FCRH
(Main
CR clock)
FCL
(sub-oscillation)
FCRL
(Sub-
CR clock)
SCLK
(source clock)
MCLK
(machine clock)
Clock mode select bits
(SYCC2: RCS1, RCS0)
Machine clock division
ratio select bits
(SYCC : DIV1, DIV0)
Division
circuit
×
1
1/4
1/8
1/16
Divided
by 2
Divided
by 2
Divided
by 2
Schematic diagram of the clock generation block
Oper
a
ting
volt
a
ge
(V)
A/D converter operation range
5.5
5.0
4.0
3.5
3.0
2.4
16 kHz
3 MHz
10 MHz
16.25 MHz
Source clock frequency (FSP/FSPL)
Oper
a
ting
volt
a
ge
(V)
A/D converter operation range
5.5
5.0
4.0
3.5
3.0
2.9
16 kHz
3 MHz
10 MHz
16.25 MHz
Source clock frequency (FSP)
Operating voltage - Operating frequency (When TA = -40
°C to + 85°C)
MB95260H/270H/280H (without the on-chip debug function)
Operating voltage - Operating frequency (When TA = -40
°C to + 85°C)
MB95260H/270H/280H (with the on-chip debug function)
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PDF描述 |
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