参数资料
| 型号： | MC100EP14DT |
| 厂商： | ON Semiconductor |
| 文件页数： | 2/9页 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFF MUX 2:5 2GHZ 20TSSOP |
| 标准包装： | 75 |
| 系列： | 100EP |
| 类型： | 扇出缓冲器（分配），多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:5 |
| 差分 - 输入:输出： | 是/是 |
| 输入： | ECL，HSTL，PECL |
| 输出： | ECL，PECL |
| 频率 - 最大： | 2GHz |
| 电源电压： | 3 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
| 其它名称： | MC100EP14DTOS |
MC100EP14
http://onsemi.com
2
Figure 1. TSSOP20 (Top View) and Logic Diagram
WARNING: All VCC and VEE pins must be externally connected
to Power Supply to guarantee proper operation.
Q2
Q1
Q3
Q1
17
18
16
15
14
13
12
4
3
56
7
8
9
11
10
CLK1
CLK0
Q0
19
20
2
1
EN
Q2
Q0
Q3
Q4
CLK1
10
D
Q
VCC
VBB
VEE
CLK_SEL
Table 1. PIN DESCRIPTION
Pin
Function
CLK0*, CLK0**
ECL/PECL/HSTL CLK Input
CLK1*, CLK1**
ECL/PECL/HSTL CLK Input
Q0:4, Q0:4
ECL/PECL Outputs
CLK_SEL*
ECL/PECL Active Clock Select Input
EN*
ECL Sync Enable
VBB
Reference Voltage Output
VCC
Positive Supply
VEE
Negative Supply
* Pins will default low when left open.
** Pins will default to VCC/2 when left open.
Table 2. FUNCTION TABLE
CLK0
CLK1
CLK_SEL
EN
Q
L
H
X
L
H
X
L
H
X
L
H
L
H
L
H
L*
* On next negative transition of CLK0 or CLK1
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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