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参数资料
| 型号： | MC100ES8111ACR2 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/12页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:10 32-LQFP |
| 标准包装： | 2,000 |
| 系列： | 100ES |
| 类型： | 扇出缓冲器（分配），多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:10 |
| 差分 - 输入:输出： | 是/是 |
| 输入： | HSTL，PECL |
| 输出： | HSTL |
| 频率 - 最大： | 625MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 110°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-TQFP（7x7） |
| 包装： | 带卷 (TR) |
MC100ES8111 DATASHEET
HSTL CLOCK FANOUT BUFFER
MC100ES8111 Revision 4
2
2009 Integrated Device Technology, Inc.
Figure 1. MC100ES8111 Logic Diagram
Figure 2. 23-Lead Package Pinout (Top View)
0
1
CLK0
CLK1
CLK_SEL
VCC
Q0
Q1
Q2
Q3
Q4
Q5
Q6
Q7
Q8
Q9
OE
Q8
VCCO
Q2
Q1
Q0
VCC0
Q7
Q9
Q3
Q4
Q5
Q6
V
CC
CLK_S
EL
CLK0
OE
CLK1
GND
25
26
27
28
29
30
31
32
15
14
13
12
11
10
9
12345
6
7
8
24
23
22
21
20
19
18
17
16
MC100ES8111
VCCO
Q2
Q1
Q0
Q7
Q8
Q9
Table 1. Pin Configuration(1)
1. Input pull-up/pull-down resistors have a value of 75 k
.
Pin
I/O
Type
Function
CLK0, CLK0
Input
HSTL
Differential HSTL reference clock signal input
CLK1, CLK1
Input
PECL
Differential PECL reference clock signal input
CLK_SEL
Input
LVCMOS
Reference clock input select
OE
Input
LVCMOS
Output enable/disable. OE is synchronous to tlhe input reference clock which
eliminates possible output runt pulses when the OE state is changed.
Q[0-9], Q[0-9]
Output
HSTL
Differential clock outputs
GND
Supply
Negative power supply
VCC
Supply
Positive power supply of the device core (3.3 V)
VCCO
Supply
Positive power supply of the HSTL outputs. All VCCO pins must be connected to the
positive power supply (1.5 V or 1.8 V) for correct DC and AC operation.
Table 2. Function Table
Control
Default
0
1
CLK_SEL
0
CLK0, CLK0 (HSTL) is the active differential clock
input
CLK1, CLK1 (PECL) is the active differential clock
input
OE
0
Q[0-9], Q[0-9] are active. Deassertion of OE can be
asynchronous to the reference clock without
generation of output runt pulses.
Q[0-9] = L, Q[0-9] =H (outputs disabled). Assertion of
OE can be asynchronous to the reference clock
without generation of output runt pulses.
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