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参数资料
| 型号： | MC68334GEH16 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 55/76页 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 16MHZ 132-PQFP |
| 标准包装： | 36 |
| 系列： | M683xx |
| 核心处理器： | CPU32 |
| 芯体尺寸： | 32-位 |
| 速度： | 16MHz |
| 连通性： | EBI/EMI，UART/USART |
| 输入/输出数： | 47 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 8x8/10b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 132-BQFP 缓冲式 |
| 包装： | 托盘 |
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MC68334
MC68334TS/D REV. 1
59
Figure 13 Prescaler Control 2
STF — Stop Flag
0 = TPU operating
1 = TPU stopped (STOP bit has been asserted)
SUPV — Supervisor Data Space
0 = Assignable registers are unrestricted (FC2 is ignored)
1 = Assignable registers are restricted (FC2 is decoded)
PSCK — Prescaler Clock
0 = System clock/32 is input to TCR1 prescaler
1 = System clock/4 is input to TCR1 prescaler
IARB — Interrupt Arbitration Identification Number
The IARB field is used to arbitrate between simultaneous interrupt requests of the same priority. Each
module that can generate interrupt requests must be assigned a unique, nonzero IARB field value. Re-
fer to 3.8 Interrupts for more information.
CIRL — Channel Interrupt Request Level
The interrupt request level for all channels is specified by this 3-bit encoded field. Level seven for this
field indicates a nonmaskable interrupt; level zero indicates that all channel interrupts are disabled.
CIBV — Channel Interrupt Base Vector
The TPU is assigned 16 unique interrupt vector numbers, one vector number for each channel. The
CIBV field specifies the most significant nibble of all 16 TPU channel interrupt vector numbers. The low-
er nibble of the TPU interrupt vector number is determined by the channel number on which the interrupt
occurs.
TICR
— TPU Interrupt Configuration Register
$YFFE08
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
NOT USED
CIRL
CIBV
NOT USED
RESET:
0
TPU PRE BLOCK 2
SYNCHRONIZER
INT CLK
÷ 8
0 – A
1 – B
T2CG CONTROL BIT
A
B
TCR2
015
TCR2
PRESCALER
00
÷ 1
01
÷ 2
10
÷ 4
11
÷ 8
T2CLK
PIN
DIGITAL
FILTER
PROGRAMMABLE
DIGITAL
FILTER
0 – A
1 – B
T2C FILTER BIT
A
B
MUX
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