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参数资料
| 型号： | MC68334GEH16 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 60/76页 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 16MHZ 132-PQFP |
| 标准包装： | 36 |
| 系列： | M683xx |
| 核心处理器： | CPU32 |
| 芯体尺寸： | 32-位 |
| 速度： | 16MHz |
| 连通性： | EBI/EMI，UART/USART |
| 输入/输出数： | 47 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 8x8/10b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 132-BQFP 缓冲式 |
| 包装： | 托盘 |
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MC68334
MC68334TS/D REV. 1
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6 Analog-to-Digital Converter Module
The analog-to-digital converter (ADC) is a unipolar, successive-approximation converter with eight
modes of operation. It has selectable 8- or 10-bit resolution. Accuracy is ±1 count (1 LSB) in 8-bit mode
and ±4 counts (2 LSB) in 10-bit mode. Monotonicity is guaranteed in both modes. The ADC can perform
an 8-bit single conversion (4-clock sample) in 10 microseconds and a 10-bit single conversion in 11 mi-
croseconds.
The ADC consists of an analog and a digital subsystem. A block diagram of the converter appears on
the following page.
6.1 Analog Subsystem
The analog front end consists of a multiplexer, a buffer amplifier, a resistor-capacitor array, and a high-
gain comparator. The multiplexer selects one of eight internal or seven external signal sources for con-
version. The resistor capacitor digital-to-analog converter (RC DAC) array performs two functions: it
acts as a sample/hold circuit, and it provides the digital-to-analog comparison output necessary for suc-
cessive approximation conversion. The comparator indicates whether each successive output of the
RC DAC array is higher or lower than the sampled input.
6.2 Digital Control Subsystem
The digital control section includes conversion sequence control logic, channel and reference select
logic, a successive approximation register, eight result registers, a port data register, and control/status
registers. It controls the multiplexer and the output of the RC DAC array during the sample and conver-
sion periods, stores the results of comparison in the successive-approximation register, and transfers
the result to a result register.
The ADC bus interface unit (ABIU) contains logic necessary to interface the ADC to the intermodule
bus. The ADC is designed to act as a slave device on the bus. The interface must respond with appro-
priate bus cycle termination signals and supply appropriate interface timing to the other submodules.
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参数描述 |
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