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参数资料
型号： MC68711E20CFNE2
厂商： Freescale Semiconductor
文件页数： 21/138页
文件大小： 0K
描述： IC MCU 8BIT 20K FLASH 52-PLCC
标准包装： 23
系列： HC11
核心处理器： HC11
芯体尺寸： 8-位
速度： 2MHz
连通性： SCI，SPI
外围设备： POR，WDT
输入/输出数： 38
程序存储器容量： 20KB（20K x 8）
程序存储器类型： OTP
EEPROM 大小： 512 x 8
RAM 容量： 768 x 8
电压 - 电源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
数据转换器： A/D 8x8b
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 52-LCC（J 形引线）
包装： 管件
产品目录页面： 723 (CN2011-ZH PDF)
Serial Peripheral Interface Timing
MC68HC711D3 Data Sheet, Rev. 2.1
Freescale Semiconductor
117
9.9 Serial Peripheral Interface Timing
Num
Characteristic(1)
1. VDD = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = TL to TH. All timing is shown with respect to 20% VDD and 70% VDD, unless
otherwise noted.
Symbol
2.0 MHz
3.0 MHz
Unit
Min
Max
Min
Max
Operating frequency
Master
Slave
fop(m)
fop(s)
dc
0.5
2.0
dc
0.5
3.0
fop
MHz
1
Cycle time
Master
Slave
tcyc(m)
tCYC(s)
2.0
500
—
2.0
333
—
tcyc
ns
2
Enable lead time
Master(2)
Slave
2. Signal production depends on software.
tlead(m)
tlead(s)
—
250
—
240
—
ns
3
Enable lag time
Master(2)
Slave
tlag(m)
tlag(s)
—
250
—
240
—
ns
4
Clock (SCK) high time
Master
Slave
tw(SCKH)m
tw(SCKH)s
340
190
—
227
127
—
ns
5
Clock (SCK) low time
Master
Slave
tw(SCKL)m
tw(SCKL)s
340
190
—
227
127
—
ns
6
Data setup time (inputs)
Master
Slave
tsu(m)
tsu(s)
100
—
100
—
ns
7
Data hold time (inputs)
Master
Slave
th(m)
th(s)
100
—
100
—
ns
8
Access time (time to data active from high-impedance state)
Slave
ta
0
120
0
120
ns
9
Disable time (hold time to high-impedance state)
Slave
tdis
—
240
—
167
ns
10
Data valid (after enable edge)(3)
3. Assumes 200 pF load on all SPI pins.
tv(s)
—
240
—
167
ns
11
Data hold time (outputs) (after enable edge)
tho
0—
0
—
ns
12
Rise time (20% VDD to 70% VDD, CL = 200 pF)
SPI outputs (SCK, MOSI, and MISO)
SPI inputs (SCK, MOSI, MISO, and SS)
trm
trs
—
100
2.0
—
100
2.0
ns
s
13
Fall time (70% VDD to 20% VDD, CL = 200 pF)
SPI outputs (SCK, MOSI, and MISO)
SPI inputs (SCK, MOSI, MISO, and SS)
tfm
tfs
—
100
2.0
—
100
2.0
ns
s
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