参数资料
型号: MC68HC05PV8YDWR2
厂商: MOTOROLA INC
元件分类: 微控制器/微处理器
英文描述: 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PDSO28
封装: SOIC-28
文件页数: 162/201页
文件大小: 1234K
代理商: MC68HC05PV8YDWR2
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CPU and Instruction Set
Instruction Set Summary
MC68HC(8)05PV8/A — Rev. 1.9
Technical Data
MOTOROLA
CPU and Instruction Set
63
NO
NDI
S
CLO
S
URE
AG
REEMENT
REQ
U
IRED
TST opr
TSTA
TSTX
TST opr,X
TST ,X
Test Memory Byte for Negative or Zero
(M) – $00
—— —
DIR
INH
IX1
IX
3D
4D
5D
6D
7D
dd
ff
4
3
5
4
TXA
Transfer Index Register to Accumulator
A
← (X)
—————
INH
9F
2
WAIT
Stop CPU Clock and Enable Interrupts
0
———
INH
8F
2
A Accumulatoropr
Operand (one or two bytes)
C Carry/borrow flagPC
Program counter
CCRCondition code registerPCH
Program counter high byte
ddDirect address of operandPCL
Program counter low byte
dd rrDirect address of operand and relative offset of branch instructionREL
Relative addressing mode
DIRDirect addressing moderel
Relative program counter offset byte
ee ffHigh and low bytes of offset in indexed, 16-bit offset addressingrr
Relative program counter offset byte
EXTExtended addressing modeSP
Stack pointer
ff Offset byte in indexed, 8-bit offset addressingX
Index register
H Half-carry flagZ
Zero flag
hh llHigh and low bytes of operand address in extended addressing#
Immediate value
I Interrupt mask
Logical AND
ii Immediate operand byte
Logical OR
IMMImmediate addressing mode
Logical EXCLUSIVE OR
INHInherent addressing mode( )
Contents of
IXIndexed, no offset addressing mode–( )
Negation (two’s complement)
IX1Indexed, 8-bit offset addressing mode
Loaded with
IX2Indexed, 16-bit offset addressing mode?
If
MMemory location:
Concatenated with
N Negative flag
Set or cleared
n Any bit—
Not affected
Table 3-6 Instruction Set Summary (Continued)
Source
Form
Operation
Description
Effect on
CCR
Addr
e
s
Mo
d
e
Opc
ode
Op
e
ra
n
d
Cycl
es
HI N Z C
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PDF描述
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MC68HC05RC16P 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:General Release Specification
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