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参数资料
| 型号： | MC68HC05V7CB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | SDIP-56 |
| 文件页数： | 36/170页 |
| 文件大小： | 980K |
| 代理商： | MC68HC05V7CB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页当前第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页
MOTOROLA
SECTION 15: MESSAGE DATA LINK CONTROLLER
Page 116
MC68HC05V7 Specification Rev. 1.0
15.5.3
J1850 VPW SYMBOLS
Variable Pulse Width Modulation (VPW) is an encoding technique in which each bit is
defined by the time between successive transitions, and by the level of the bus between
transitions, active or passive. Active and passive bits are used alternately.
Each logic one or logic zero contains a single transition, and can be at either the active or
passive level and one of two lengths, either 64
s or 128 s (T
NOM at 10.4 kbps baud rate),
depending upon the encoding of the previous bit. The SOF, EOD, EOF and IFS symbols
will always be encoded at an assigned level and length. See Figure 15-11:
Each message will begin with an SOF symbol, an active symbol, and therefore each data
byte (including the CRC byte) will begin with a passive bit, regardless of whether it is a logic
one or a logic zero.
All VPW bit lengths stated in the following descriptions are typical values at a 10.4 kbps bit
rate.
128
s
Active
Passive
64
s
OR
Logic "0"
128
s
Active
Passive
64
s
OR
Logic "1"
200
s
Active
Passive
Start of Frame
200
s
End of Data
280
s
Active
Passive
End of Frame
≥ 280 s
Break
(a)
(b)
(c)
(d)
(e)
(f)
Figure 15-11 :
J1850 VPW Symbols
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC711EA9VFS3 | 8-BIT, UVPROM, 3 MHz, MICROCONTROLLER, CQCC52 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| MC68HC05X4CDW | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS Microcontroller Unit |
| MC68HC05X4DW | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS Microcontroller Unit |
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