参数资料
型号: MC68HC08GP16AMB
厂商: MOTOROLA INC
元件分类: 微控制器/微处理器
英文描述: 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PDIP42
封装: SDIP-42
文件页数: 20/286页
文件大小: 3807K
代理商: MC68HC08GP16AMB
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Mask Option Registers (MOR2 and MOR1)
Data Sheet
MC68HC08GP32A MC68HC08GP16A
116
Mask Option Registers (MOR2 and MOR1)
MOTOROLA
COPRS — COP Rate Select Bit
COPRS selects the COP timeout period. See Section 5. Computer Operating
1 = COP timeout period = 213 – 24 CGMXCLK cycles
0 = COP timeout period = 218 – 24 CGMXCLK cycles
LVISTOP — LVI Enable in Stop Mode Bit
When the LVIPWRD bit is clear, setting the LVISTOP bit enables the LVI to
operate during stop mode. See 9.5.2 Stop Mode.
1 = LVI enabled during stop mode
0 = LVI disabled during stop mode
LVIRSTD — LVI Reset Disable Bit
LVIRSTD disables the reset signal from the LVI module. See
1 = LVI module resets disabled
0 = LVI module resets enabled
LVIPWRD — LVI Power Disable Bit
LVIPWRD disables the LVI module. See Section 10. Low-Voltage Inhibit
1 = LVI module power disabled
0 = LVI module power enabled
LVI5OR3 — LVI 5-V or 3-V Operating Mode Bit
LVI5OR3 selects the voltage operating mode of the LVI module. See Section
10. Low-Voltage Inhibit (LVI). The voltage mode selected for the LVI should
match the operating VDD. See Section 20. Electrical Specifications for the
LVI’s voltage trip points for each of the modes.
1 = LVI operates in 5-V mode
0 = LVI operates in 3-V mode
SSREC — Short Stop Recovery Bit
SSREC enables the CPU to exit stop mode with a delay of 32 CGMXCLK cycles
instead of a 4096-CGMXCLK cycle delay.
1 = Stop mode recovery after 32 CGMXCLK cycles
0 = Stop mode recovery after 4096 CGMXCLKC cycles
NOTE:
Exiting stop mode by pulling reset will result in the long stop recovery.
Address:
$001F
Bit 7
654321
Bit 0
Read:
COPRS
LVISTOP
LVIRSTD
LVIPWRD
LVI5OR3
SSREC
STOP
COPD
Write:
Reset:
Mask defined
Figure 11-2. Mask Option Register 1 (MOR1)
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