参数资料
型号: MC68HC08GP16AMB
厂商: MOTOROLA INC
元件分类: 微控制器/微处理器
英文描述: 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PDIP42
封装: SDIP-42
文件页数: 66/286页
文件大小: 3807K
代理商: MC68HC08GP16AMB
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Serial Communications Interface (SCI) Module
Data Sheet
MC68HC08GP32A MC68HC08GP16A
158
Serial Communications Interface (SCI) Module
MOTOROLA
14.4.3.2 Character Reception
During an SCI reception, the receive shift register shifts characters in from the
PTE1/RxD pin. The SCI data register (SCDR) is the read-only buffer between the
internal data bus and the receive shift register.
After a complete character shifts into the receive shift register, the data portion of
the character transfers to the SCDR. The SCI receiver full bit, SCRF, in SCI status
register 1 (SCS1) becomes set, indicating that the received byte can be read. If the
SCI receive interrupt enable bit, SCRIE, in SCC2 is also set, the SCRF bit
generates a receiver CPU interrupt request.
14.4.3.3 Data Sampling
The receiver samples the PTE1/RxD pin at the RT clock rate. The RT clock is an
internal signal with a frequency 16 times the baud rate. To adjust for baud rate
mismatch, the RT clock is resynchronized at the following times (see Figure 14-7):
After every start bit
After the receiver detects a data bit change from 1 to 0 (after the majority of
data bit samples at RT8, RT9, and RT10 returns a valid 1 and the majority
of the next RT8, RT9, and RT10 samples returns a valid 0)
To locate the start bit, data recovery logic does an asynchronous search for a 0
preceded by three 1s. When the falling edge of a possible start bit occurs, the RT
clock begins to count to 16.
Figure 14-7. Receiver Data Sampling
RT CLOCK
RESET
RT1
RT2
RT3
RT4
RT5
RT8
RT7
RT6
RT
11
RT
10
RT9
RT
15
RT
14
RT
13
RT
12
RT
16
RT1
RT2
RT3
RT4
START BIT
QUALIFICATION
START BIT
VERIFICATION
DATA
SAMPLING
SAMPLES
RT
CLOCK
RT CLOCK
STATE
START BIT
LSB
PTE1/RxD
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