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参数资料
| 型号： | MC68HC705F4FB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 1.789 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | PLASTIC, QFP-44 |
| 文件页数： | 110/130页 |
| 文件大小： | 10504K |
| 代理商： | MC68HC705F4FB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页当前第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页
8-6
MC68HC05F4
RESETS AND INTERRUPTS
8
8.2.3.2
Programmable 16-bit timer interrupt
There are ve different timer interrupt ags that cause a timer interrupt whenever they are set and
enabled. The timer interrupt enable bits are located in the timer control register (TCR) and the
timer interrupt ags are located in the timer status register (TSR). Both interrupts will vector to the
same service routine, whose start address is contained in memory locations $3FF6 and $3FF7.
8.2.3.3
Keyboard interrupt
When congured as input pins, all eight port A lines provide a wired-OR keyboard interrupt facility
and will generate an interrupt, provided that the keyboard interrupt enable bit (KIE) in the key
control register (KCR) is set. The address of the interrupt service routine is specied by the
contents of memory locations $3FFA and $3FFB. Since this interrupt vector is shared with the IRQ
external interrupt function the interrupt service routine should check KF to determine the interrupt
source. KF should be cleared by software in the interrupt service routine. Care must be taken to
allow adequate time for switch debounce before clearing the ag.
8.2.3.4
Low voltage interrupt
There is a low voltage interrupt ag that causes an interrupt whenever it is set and enabled. The
low voltage interrupt enable bit and the interrupt ag are located in the system option register
(SOR) described below in Section 8.2.3.5. This interrupt will vector to the service routine, located
at the address specied by the contents of memory locations $3FF4 and $3FF5.
Table 8-1 Vector address for interrupts and reset
Register
Flag name
Interrupts
CPU
interrupt
Vector address
Reset
RESET
$3FFE$3FFF
Software interrupt
SWI
$3FFC$3FFD
External interrupt
IRQ
$3FFA$3FFB
CTCSR
CTOF
Core timer overow
CTIMER
$3FF8$3FF9
CTCSR
RTIF
Real time interrupt
CTIMER
$3FF8$3FF9
TSR
IC1F
Timer input capture1
TIMER
$3FF6$3FF7
TSR
OC1F
Timer output compare1
TIMER
$3FF6$3FF7
TSR
IC2F
Timer input capture2
TIMER
$3FF6$3FF7
TSR
OC2F
Timer output compare2
TIMER
$3FF6$3FF7
TSR
TOF
Timer overow
TIMER
$3FF6$3FF7
KCR
KF
Keyboard interrupt
KEYF
$3FFA$3FFB
SOR
LVIF
Low voltage interrupt
LVI
$3FF4$3FF5
TPG
76
05F4Book Page 6 Tuesday, August 5, 1997 1:10 pm
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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c
..
.
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PDF描述 |
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