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参数资料
| 型号： | MC68HC711D3MFN3 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 3 MHz, MICROCONTROLLER, PQCC44 |
| 封装： | PLASTIC, LCC-44 |
| 文件页数： | 123/157页 |
| 文件大小： | 2252K |
| 代理商： | MC68HC711D3MFN3 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页当前第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页
Input/Output (I/O) Ports
Data Sheet
MC68HC711D3 — Rev. 2
68
Input/Output (I/O) Ports
MOTOROLA
5.2 Port A
Port A shares functions with the timer system and has:
Three input only pins
Three output only pins
Two bidirectional I/O pins
Pins PA6 and PA4 are not bonded in the 40-pin dual in-line package (DIP), and
their OC output functions are unavailable, but their software interrupts are
available.
PORTA can be read any time. Inputs return the pin level, whereas outputs return
the pin driver input level. If written, PORTA stores the data in an internal latch. It
drives the pins only if they are configured as outputs. Writes to PORTA do not
change the pin state when the pins are configured for timer output compares.
Out of reset, port A bits 7 and 3–0 are general high-impedance inputs, while
bits 6–4 are outputs, driving low. On bidirectional lines PA7 and PA3, the timer
forces the I/O state to be an output if the associated output compare is enabled. In
this case, the data direction bits DDRA7 and DDRA3 in PACTL will not be changed
or have any effect on those bits. When the output compare functions associated
with these pins are disabled, the DDR bits in PACTL govern the I/O state.
Address:
$0000
Bit 7
654321
Bit 0
Read:
PA7
PA6(1)
PA5
PA4(1)
PA3
PA2
PA1
PA0
Write:
Reset:
Hi-Z
0
Hi-Z
Alt. Func.:
And/Or:
PAI
OC1
OC2
OC1
OC3
OC1
OC4
OC1
IC4/OC5
OC1
IC1
—
IC2
—
IC3
—
1. This pin is not bonded in the 40-pin version.
Figure 5-1. Port A Data Register (PORTA)
相关PDF资料 |
PDF描述 |
|---|---|
| MCC68HC711D3 | 8-BIT, OTPROM, 3 MHz, MICROCONTROLLER, UUC |
| MC68HC711D3MP2 | 8-BIT, OTPROM, 2 MHz, MICROCONTROLLER, PDIP40 |
| MC68HC711D3S | 8-BIT, UVPROM, 2.1 MHz, MICROCONTROLLER, CDIP40 |
| MC68HC711D3FN | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC44 |
| MC68HC711G5CFN | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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