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参数资料
| 型号： | MC68HC711D3MFN3 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 3 MHz, MICROCONTROLLER, PQCC44 |
| 封装： | PLASTIC, LCC-44 |
| 文件页数： | 3/157页 |
| 文件大小： | 2252K |
| 代理商： | MC68HC711D3MFN3 |
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Programmable Timer
Data Sheet
MC68HC711D3 — Rev. 2
100
Programmable Timer
MOTOROLA
functions only if the I4/O5 bit in PACTL is set. Refer to Table 8-2 for timer control
configuration.
8.3.2 Timer Input Capture Registers
When an edge has been detected and synchronized, the 16-bit free-running
counter value is transferred into the input capture register pair as a single 16-bit
parallel transfer. Timer counter value captures and timer counter incrementing
occur on opposite half-cycles of the phase two clock so that the count value is
stable whenever a capture occurs. The timer input capture (TICx) registers are not
affected by reset. Input capture values can be read from a pair of 8-bit read-only
registers. A read of the high-order byte of an input capture register pair inhibits a
new capture transfer for one bus cycle. If a double-byte read instruction, such as
LDD, is used to read the captured value, coherency is assured. When a new input
capture occurs immediately after a high-order byte read, transfer is delayed for an
additional cycle but the value is not lost.
Table 8-2. Timer Control Configuration
EDGxB
EDGxA
Configuration
0
Capture disabled
0
1
Capture on rising edges only
1
0
Capture on falling edges only
1
Capture on any edge
Address: $0010 — TIC1 (High)
Bit 15
14
13
12
11
10
9
Bit 8
Read:
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
Write:
Reset:
Unaffected by reset
Address: $0011 — TIC1 (Low)
Bit 7
654321
Bit 0
Read:
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Write:
Reset:
Unaffected by reset
Address: $0012 — TIC2 (High)
Bit 15
14
13
12
11
10
9
Bit 8
Read:
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
Write:
Reset:
Unaffected by reset
= Unimplemented
Figure 8-4. Timer Input Capture Registers (TICx)
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PDF描述 |
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