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参数资料
| 型号： | MC68HC711D3MP2 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2 MHz, MICROCONTROLLER, PDIP40 |
| 封装： | PLASTIC, DIP-40 |
| 文件页数： | 151/157页 |
| 文件大小： | 2252K |
| 代理商： | MC68HC711D3MP2 |
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Serial Peripheral Interface (SPI)
SPI Registers
MC68HC711D3 — Rev. 2
Data Sheet
MOTOROLA
Serial Peripheral Interface (SPI)
93
SPR1 and SPR0 — SPI Clock Rate Select Bits
These two serial peripheral rate bits select one of four baud rates to be used as
SCK if the device is a master; however, they have no effect in the slave mode.
7.7.2 SPI Status Register
SPIF — SPI Transfer Complete Flag
SPIF is set upon completion of data transfer between the processor and the
external device. If SPIF goes high, and if SPIE is set, a serial peripheral interrupt
is generated. To clear the SPIF bit, read the SPSR with SPIF set, then access
the SPDR. Unless SPSR is read (with SPIF set) first, attempts to write SPDR
are inhibited.
WCOL — Write Collision Bit
Clearing the WCOL bit is accomplished by reading the SPSR (with WCOL set)
followed by an access of SPDR. Refer to 7.5.4 Slave Select (SS) and 7.6 SPI
0 = No write collision
1 = Write collision
Bit 5 — Not implemented
Always reads 0.
MODF — Mode Fault Bit
To clear the MODF bit, read the SPSR (with MODF set), then write to the SPCR.
Refer to 7.5.4 Slave Select (SS) and 7.6 SPI System Errors.
0 = No mode fault
1 = Mode fault
Bits 3–0 — Not implemented
Always reads 0
Table 7-1. SPI Clock Rates
SPR1
and SPR0
E Clock
Divide By
Frequency at
E = 2 MHz (Baud)
0 0
2
1.0 MHz
0 1
4
500 kHz
1 0
16
125 kHz
1 1
32
62.5 kHz
Address:
$0029
Bit 7
654321
Bit 0
Read:
SPIF
WCOL
0
MODF
0000
Write:
Reset:
00000000
Figure 7-4. SPI Status Register (SPSR)
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC711D3S | 8-BIT, UVPROM, 2.1 MHz, MICROCONTROLLER, CDIP40 |
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| MC68HC711G5CFN | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
| MC68HC11G7CFN | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
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相关代理商/技术参数 |
参数描述 |
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