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参数资料
| 型号： | MC68HC711G5CFN |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
| 封装： | PLASTIC, LCC-84 |
| 文件页数： | 54/195页 |
| 文件大小： | 1940K |
| 代理商： | MC68HC711G5CFN |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页当前第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页
EVENT COUNTER
11-17
The following table applies to mode 0 only:
EVI2C
EVI2B
EVI2A
Clear input mode for EVCNT2
0
X
Not used
1
0
Falling edge of EVI2 (PH4)
1
0
1
Rising edge of EVI2 (PH4)
1
0
Logic HIGH (1) level on EVI2
1
Logic LOW (0) level on EVI2
In mode 0, EVI2 is used as a “clear” input to (EVCNT2).
Note:
In mode 2, these three bits should be reset to zero to allow PH4 to be used as an I/O port.
EVI1C, EVI1B, EVI1A — Event Input Select 1 (EVI1)
These three bits determine the operation of event input unit 1 as shown in the following
table.
The following table applies to modes 0, 1 and 2 only:
EVI1C
EVI1B
EVI1A
PH5
Clock Source
Count Mode
0
I/O
Count stop
0
1
I/O
Scaled E
Count always
0
1
0
EVI1
Scaled E
Inhibit counting on EVI1 = 0
0
1
EVI1
Scaled E
Inhibit counting on EVI1 = 1
1
0
EVI1
External
Count on falling edge of EVI1
1
0
1
EVI1
External
Count on rising edge of EVI1
1
X
EVI1
External
Count on both falling and
rising edges of EVI1
Note:
In mode 3, these three bits should be reset to zero to allow PH5 to be used as an I/O port.
11.6.3
Counters Enable/Interrupt Mask Register (EVMSK)
EVCEN
EV2I
EV1I
EVMSK
$1072
7
6
5
4
3
2
1
0
RESET:
READ:
Any time.
WRITE:
Any time.
RESET:
$00.
EVCEN — Event Counters Enable
0 – Event counters EVCNT1 and EVCNT2 are cleared. Also the event output (EVO)
is cleared to a logic low level (when EVPOL = 0 and EVOEN = 1). The EVCLK and
EVCTL registers should be written while this bit is “0”.
1 – Event counters are enabled.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC11G7CFN | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
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相关代理商/技术参数 |
参数描述 |
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