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参数资料
| 型号： | MC68HC711G5CFN |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
| 封装： | PLASTIC, LCC-84 |
| 文件页数： | 96/195页 |
| 文件大小： | 1940K |
| 代理商： | MC68HC711G5CFN |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页当前第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页
ELECTRICAL SPECIFICATIONS
13-19
13.10 SERIAL PERIPHERAL INTERFACE (SPI) TIMING
(VDD = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = TL to TH unless otherwise noted)
Num
Characteristic
Symbol
Min
Max
Unit
Operating Frequency
Master
Slave
fop(s)
dc
0.5
2.1
fo
MHz
1
Cycle Time
Master
Slave
tcyc(m)
tcyc(s)
2.0
480
—
tcyc
ns
2
Enable Lead Time
Master
Slave
tlead(m)
tlead(s)
*
240
—
ns
3
Enable Lag Time
Master
Slave
tlag(m)
tlag(s)
*
240
—
ns
4
Clock (SCK) High Time
Master
Slave
tw(SCKH)m
tw(SCKH)s
340
190
—
ns
5
Clock (SCK) Low Time
Master
Slave
tw(SCKL)m
340
190
—
ns
6
Data Setup Time
Master
Slave
100
—
ns
7
Data Hold Time
Master
Slave
tsu(m)
tsu(s)
th(m)
th(s)
100
—
ns
8
Access Time
(Time to Data Active from High-Impedance State)
Slave
ta
0
120
ns
9
Disable Time
(Hold Time to High-Impedance State)
Slave
tdis
—
240
ns
10
Data Valid (After Enable Edge)**
tv(s)
—
240
ns
11
Data Hold Time (Outputs) (After Enable Edge)
tho
- 40
—
ns
fop(m)
tw(SCKL)s
12
Rise Time (20% V DD to 70% VDD, CL = 200pF)
SPI Outputs (SCK, MOSI, MISO)
SPI Inputs (SCK, MOSI, MISO, SS)
tr(m)
tr(s)
—
100
2.0
ns
s
13
Fall Time (70% V DD to 20% VDD, CL = 200pF)
SPI Outputs (SCK, MOSI, MISO)
SPI Inputs (SCK, MOSI, MISO, SS)
tf(m)
tf(s)
—
100
2.0
ns
s
NOTES:
*
Signal production depends on software.
**
Assumes 200 pF load on all SPI pins.
1.
All timing is shown with respect to 20% V DD and 70% VDD unless otherwise noted.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC11G7CFN | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
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