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参数资料
| 型号： | MC68HC805P18MP |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, EEPROM, 2.1 MHz, MICROCONTROLLER, PDIP28 |
| 封装： | PLASTIC, DIP-28 |
| 文件页数： | 31/144页 |
| 文件大小： | 1292K |
| 代理商： | MC68HC805P18MP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页当前第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页
Advance Information
MC68HC(8)05P18 — Rev. 2.0
126
Electrical Specifications
MOTOROLA
Electrical Specications
13.7 DC Electrical Characteristics
Characteristic(1)
1. VDD = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = –40°C to +125°C, all values shown reflect average measurements.
Symbol
Min
Max
Unit
Output voltage
ILoad = 10.0 A
VOL
VOH
—
VDD –0.1
0.1
—
V
Output high voltage
ILoad = –0.8 mA: PA0–PA7, PB5–PB7, PC2–PC7, PD5/CKOUT
ILoad = –5 mA: PC0, PC1
VOH
VDD –0.8
—V
Output low voltage
ILoad = 1.6 mA: PA0–PA7, PB5–PB7, PC2–PC7, PD5/CKOUT
ILoad = 10 mA: PC0, PC1
VOL
—
0.4
V
Input high voltage
PA0–PA7, PB5–PB7, PC0–PC7, PD5/CKOUT, TCAP/PD7, IRQ,
RESET, OSC1
VIH
0.7 x VDD
VDD
V
Input low voltage
PA0–PA7, PB5–PB7, PC0–PC7, PD5, TCAP/PD7, IRQ, RESET,
OSC1
VIL
VSS
0.2 x VDD
V
Supply current(2) (3) (4) (5) (6) (7)
Low frequency (2-MHz bus)
Run
Wait (A2D on)
Wait (A2D off)
High frequency (4-MHz bus) MC68HC05P18 only
Run
Wait (A2D on)
Wait (A2D off)
Stop (–40
°C to +132°C)
Stop LVR disabled
Stop LVR enabled
2. Run (operating) IDD, wait IDD: Measured using external square wave clock source (fosc = 4.2 MHz), all inputs
0.2 V from rail; no dc loads, less than 50 pF on all outputs, CL = 20 pF on OSC2
3. Wait IDD with active systems: timer, SIOP, and A/D. Wait IDD is affected linearly by the OSC2 capacitance.
4. Wait, stop IDD: All ports congured as inputs, VIL = 0.2 V, VIH = VDD –0.2 V
5. Stop IDD measured with OSC1 = VSS. Stop IDD maximum values given with LVR option enabled.
6. Run and wait IDD limit values are with no load on PD5 clock out, when PD5 is enabled.
7. Run and wait IDD values are for both PD5 enabled and disabled and LVR enabled and disabled.
IDD
—
4
3.5
2.5
6
4.5
3.5
50
200
mA
A
I/O ports hi-z leakage current
PA0–PA7, PB5–PB7, PC0–PC7, PD5/CKOUT, TCAP/PD7
IIL
—
±10
A
I/O ports switch resistance (pullup enabled PA0–PA7)
RPTA
730
k
A/D ports hi-z leakage current
PC3–PC7
IIL
—
±1
A
Input current
RESET, IRQ, OSC1
IIN
—
±1
A
Capacitance
Ports (as input or output)
RESET, IRQ
COut
CIn
—
12
8
pF
EEPROM program/erase time (128 byte array)
Byte
Block (erase only)
Bulk (erase only)
—
5
15
50
ms
Low-voltage reset voltage
—
3.5
4.3
V
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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