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参数资料
| 型号： | MC8640DTHX1000HE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 90/130页 |
| 文件大小： | 0K |
| 描述： | IC DUAL CORE PROCESSOR 1023-CBGA |
| 标准包装： | 1 |
| 系列： | MPC86xx |
| 处理器类型： | 32-位 MPC86xx PowerPC |
| 速度： | 1.0GHz |
| 电压： | 1.05V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 1023-BCBGA，FCCBGA |
| 供应商设备封装： | 1023-FCCBGA（33x33） |
| 包装： | 托盘 |
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MPC8640 and MPC8640D Integrated Host Processor Hardware Specifications, Rev. 3
62
Freescale Semiconductor
High-Speed Serial Interfaces (HSSI)
Figure 41. Differential Reference Clock Input DC Requirements (External AC-Coupled)
Figure 42. Single-Ended Reference Clock Input DC Requirements
13.2.3
Interfacing With Other Differential Signaling Levels
The following list explains characteristics of interfacing with other differential signaling levels.
With on-chip termination to SGND, the differential reference clocks inputs are HCSL (high-speed
current steering logic) compatible DC-coupled.
Many other low voltage differential type outputs like LVDS (low voltage differential signaling) can
be used but may need to be AC-coupled due to the limited common mode input range allowed (100
to 400 mV) for DC-coupled connection.
LVPECL outputs can produce signal with too large amplitude. It may need to be DC-biased at
clock driver output first and followed with series attenuation resistor to reduce the amplitude, in
addition to AC-coupling.
SD
n_REF_CLK
SD
n_REF_CLK
Vcm
200mV < Input Amplitude or Differential Peak < 800mV
Vmax < Vcm + 400 mV
Vmin > Vcm – 400 mV
SD
n_REF_CLK
SD
n_REF_CLK
400 mV < SD
n_REF_CLK Input Amplitude < 800 mV
0V
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PDF描述 |
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参数描述 |
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