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参数资料
| 型号： | MC9328MX1DVM20R2 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 200 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | 14 X 14 MM, 1.30 MM HEIGHT, 0.80 MM PITCH, MAPBGA-256 |
| 文件页数： | 55/94页 |
| 文件大小： | 1487K |
| 代理商： | MC9328MX1DVM20R2 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页当前第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
Specifications
MOTOROLA
MC9328MX1 Advance Information
59
Figure 44. Slave SPI Timing Diagram FIFO Advanced by SS Rising Edge
3.13 LCD Controller
This section includes timing diagrams for the LCD controller. For detailed timing diagrams of the LCD
controller with various display configurations, refer to the LCD controller chapter of the MC9328MX1
Reference Manual.
Figure 45. SCLK to LD Timing Diagram
Ref
No.
Parameter
Minimum
Maximum
Unit
1
SPI_RDY to SS output low
2T 1
1.
T = CSPI system clock period (PERCLK2).
–ns
2SS output low to first SCLK edge
3Tsclk 2
2.
Tsclk = Period of SCLK.
–ns
3
Last SCLK edge to SS output high
2Tsclk
–
ns
4SS output high to SPI_RDY low
0
–
ns
5SS output pulse width
Tsclk + WAIT 3
3.
WAIT = Number of bit clocks (SCLK) or 32.768 KHz clocks per Sample
Period Control Register.
–ns
6SS input low to first SCLK edge
T
–
ns
7SS input pulse width
T
–
ns
Table 27. LCDC SCLK Timing Parameter Table
Ref No.
Parameter
Minimum
Maximum
Unit
1
SCLK to LD valid
–
2
ns
6
7
SS (input)
SCLK, MOSI, MISO
1
LSCLK
LD[15:0]
相关PDF资料 |
PDF描述 |
|---|---|
| MC9328MX21DVMR2 | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA289 |
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相关代理商/技术参数 |
参数描述 |
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