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参数资料
型号： MC9328MX21DVK
厂商： FREESCALE SEMICONDUCTOR INC
元件分类： 微控制器/微处理器
英文描述： 32-BIT, 266 MHz, MICROPROCESSOR, PBGA289
封装： 14 X 14 MM, 1.41 MM HEIGHT, 0.65 MM PITCH, LEAD FREE, PLASTIC, MAPBGA-289
文件页数： 53/100页
文件大小： 1979K
代理商： MC9328MX21DVK
MC9328MX21 Technical Data, Rev. 3.4
56
Freescale Semiconductor
Specifications
11a
(Tx) CK high to STXD high
0.34
0.72
0.34
0.72
ns
11b
(Tx) CK high to STXD low
0.34
0.72
0.34
0.72
ns
12
(Tx) CK high to STXD high impedance
0.34
0.48
0.34
0.48
ns
13
SRXD setup time before (Rx) CK low
21.50
–
21.50
–
ns
14
SRXD hold time after (Rx) CK low
0
–
0
–
ns
External Clock Operation (SSI2 Ports)
15
(Tx/Rx) CK clock period1 90
.91
–
90.91
–
ns
16
(Tx/Rx) CK clock high period
36.36
–
36.36
–
ns
17
(Tx/Rx) CK clock low period
36.36
–
36.36
–
ns
18
(Tx) CK high to FS (bl) high
10.40
17.37
8.67
15.88
ns
19
(Rx) CK high to FS (bl) high
11.00
19.70
9.28
18.21
ns
20
(Tx) CK high to FS (bl) low
10.40
17.37
8.67
15.88
ns
21
(Rx) CK high to FS (bl) low
11.00
19.70
9.28
18.21
ns
22
(Tx) CK high to FS (wl) high
10.40
17.37
8.67
15.88
ns
23
(Rx) CK high to FS (wl) high
11.00
19.70
9.28
18.21
ns
24
(Tx) CK high to FS (wl) low
10.40
17.37
8.67
15.88
ns
25
(Rx) CK high to FS (wl) low
11.00
19.70
9.28
18.21
ns
26
(Tx) CK high to STXD valid from high impedance
9.59
17.08
7.86
15.59
ns
27a (Tx) CK high to STXD high
9.59
17.08
7.86
15.59
ns
27b (Tx) CK high to STXD low
9.59
17.08
7.86
15.59
ns
28
(Tx) CK high to STXD high impedance
9.59
16.84
7.86
15.35
ns
29
SRXD setup time before (Rx) CK low
2.52
–
2.52
–
ns
30
SRXD hole time after (Rx) CK low
0
–
0
–
ns
Synchronous Internal Clock Operation (SSI2 Ports)
31
SRXD setup before (Tx) CK falling
20.78
–
20.78
–
ns
32
SRXD hold after (Tx) CK falling
0
–
0
–
ns
Synchronous External Clock Operation (SSI2 Ports)
33
SRXD setup before (Tx) CK falling
4.42
–
4.42
–
ns
34
SRXD hold after (Tx) CK falling
0
–
0
–
ns
1. All the timings for the SSI are given for a non-inverted serial clock polarity (TSCKP/RSCKP = 0) and a non-inverted frame sync
(TFSI/RFSI = 0). If the polarity of the clock and/or the frame sync have been inverted, all the timing remains valid by inverting
the clock signal STCK/SRCK and/or the frame sync STFS/SRFS shown in the tables and in the figures.
Table 36. SSI to SSI2 Ports Timing Parameters (Continued)
Ref
No.
Parameter
1.8 V
± 0.1 V
3.0 V
± 0.3 V
Unit
Minimum
Maximum
Minimum
Maximum
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MC9328MX21S 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:i.MX family of microprocessors 266 MHz
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