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参数资料
| 型号： | MC9S12C32CPB |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP52 |
| 封装： | LQFP-52 |
| 文件页数： | 73/94页 |
| 文件大小： | 906K |
| 代理商： | MC9S12C32CPB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页当前第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
Device User Guide — 9S12C32DGV1/D V01.01
75
With the above inputs the resistance can be calculated as:
The capacitance Cs can now be calculated as:
The capacitance Cp should be chosen in the range of:
The stabilization delays shown in Table A-17 are dependant on PLL operational settings and external
component selection (e.g. crystal, XFC filter).
A.4.3.2 Jitter Information
NOTE:
This section is under construction
The basic functionality of the PLL is shown in Figure A-2. With each transition of the clock fcmp, the
deviation from the reference clock fref is measured and input voltage to the VCO is adjusted
accordingly.The adjustment is done continuously with no abrupt changes in the clock output frequency.
Noise, voltage, temperature and other factors cause slight variations in the control loop resulting in a clock
jitter. This jitter affects the real minimum and maximum clock periods as illustrated in Figure A-3.
n
f
VCO
f
ref
-------------
2
synr
1
+
()
==
R
2
π nf
C
KΦ
-----------------------------
=
C
s
2
ζ
2
π f
C R
----------------------
0.516
f
C R
---------------
ζ 0.9
=
()
;
≈
=
C
s 20
C
p
C
s 10
≤≤
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