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参数资料
| 型号： | MCF53013CQT240 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | MICROPROCESSOR, PQFP208 |
| 封装： | 28 X 28 MM, ROHS COMPLIANT, LQFP-208 |
| 文件页数： | 33/62页 |
| 文件大小： | 2365K |
| 代理商： | MCF53013CQT240 |
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Preliminary Electrical Characteristics
MCF5301x Data Sheet, Rev. 5
Preliminary—Subject to Change Without Notice
Freescale Semiconductor
39
Figure 26. MII Serial Management Channel TIming Diagram
5.14
32-Bit Timer Module Timing Specifications
Table 25 lists timer module AC timings.
5.15
DSPI Timing Specifications
The DMA Serial Peripheral Interface (DSPI) provides a synchronous serial bus with both master and slave operations. Many
of the transfer attributes are programmable. Table 26 provides DSPI timing characteristics for classic SPI timing modes. Refer
to the DSPI chapter of the MCF5301x Reference Manual for information on the modified transfer formats used for
communicating with slower peripheral devices.
Table 25. Timer Module AC Timing Specifications
Name
Characteristic
Min
Max
Unit
T1
DT0IN / DT1IN / DT2IN / DT3IN cycle time
3
—
tCYC
T2
DT0IN / DT1IN / DT2IN / DT3IN pulse width
1
—
tCYC
Table 26. DSPI Module AC Timing Specifications1
Name
Characteristic
Symbol
Min
Max
Unit
Notes
DS1
DSPI_SCK Cycle Time
tSCK
4 x tSYS
—ns
2
DS2
DSPI_SCK Duty Cycle
—
(tsck
÷ 2) – 2.0 (tsck ÷ 2) + 2.0
ns
3
Master Mode
DS3
DSPI_PCSn to DSPI_SCK delay
tCSC
(2
× t
SYS) – 1.5
—
ns
4
DS4
DSPI_SCK to DSPI_PCSn delay
tASC
(2
× t
SYS) – 3.0
—
ns
5
DS5
DSPI_SCK to DSPI_SOUT valid
—
5
ns
DS6
DSPI_SCK to DSPI_SOUT invalid
—
–5
—
ns
DS7
DSPI_SIN to DSPI_SCK input setup
—
9
—
ns
DS8
DSPI_SCK to DSPI_SIN input hold
—
0
—
ns
Slave Mode
DS9
DSPI_SCK to DSPI_SOUT valid
—
4
ns
MDC (Output)
E11
MDIO (Output)
MDIO (Input)
E11
E12
E13
Valid Data
E14
E15
Valid Data
E10
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