参数资料
型号: MCIMX255AJM4
厂商: Freescale Semiconductor
文件页数: 126/140页
文件大小: 0K
描述: MPU IMX25 AUTO 400-MAPBGA
特色产品: MCIMX25 Applications Processors
标准包装: 90
系列: i.MX25
核心处理器: ARM9
芯体尺寸: 32-位
速度: 400MHz
连通性: 1 线,CAN,EBI/EMI,以太网,I²C,MMC,智能卡,SPI,SSI,UART/USART,USB OTG
外围设备: DMA,I²S,LCD,POR,PWM,WDT
输入/输出数: 128
程序存储器类型: 外部程序存储器
RAM 容量: 144K x 8
电压 - 电源 (Vcc/Vdd): 1.15 V ~ 1.52 V
数据转换器: A/D 3x12b
振荡器型: 外部
工作温度: -40°C ~ 85°C
封装/外壳: 400-LFBGA
包装: 托盘
i.MX25 Applications Processor for Automotive Products, Rev. 10
86
Freescale Semiconductor
3.7.9.1.5
MII Transmit Signal Timing (FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER, and
FEC_TX_CLK)
The transmitter functions correctly up to an FEC_TX_CLK maximum frequency of 25 MHz + 1%. There
is no minimum frequency requirement. Additionally, the processor clock frequency must exceed twice the
FEC_TX_CLK frequency.
Figure 56 shows MII transmit signal timings. Table 63 describes the timing parameters (M5–M8) shown
in the figure.
Figure 56. MII Transmit Signal Timing Diagram
1 FEC_TX_EN, FEC_TX_CLK, and FEC_TXD0 have the same timing in 10-Mbps 7-wire interface mode.
3.7.9.1.6
MII Asynchronous Inputs Signal Timing (FEC_CRS and FEC_COL)
Figure 57 shows MII asynchronous input timings. Table 64 describes the timing parameter (M9) shown in
the figure.
Figure 57. MII Async Inputs Timing Diagram
Table 63. MII Transmit Signal Timing
ID
Characteristic1
Min.
Max.
Unit
M5
FEC_TX_CLK to FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER invalid
5
ns
M6
FEC_TX_CLK to FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER valid
20
ns
M7
FEC_TX_CLK pulse width high
35%
65%
FEC_TX_CLK period
M8
FEC_TX_CLK pulse width low
35%
65%
FEC_TX_CLK period
FEC_TX_CLK (input)
FEC_TXD[3:0] (outputs)
FEC_TX_EN
FEC_TX_ER
M7
M8
M5
M6
FEC_CRS, FEC_COL
M9
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PDF描述
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