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参数资料
| 型号： | MCIMX255AJM4A |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 400 MHz, MICROPROCESSOR, PBGA400 |
| 封装： | 17 X 17 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, MAPBGA-400 |
| 文件页数： | 104/140页 |
| 文件大小： | 1416K |
| 代理商： | MCIMX255AJM4A |
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i.MX25 Applications Processor for Automotive Products, Rev. 8
66
Freescale Semiconductor
Figure 32. DDR2 SDRAM Write Cycle Timing Diagram
Table 52. DDR2 SDRAM Write Cycle Parameter Table
ID
Parameter
Symbol
DDR2-400
Unit
Min.
Max.
DDR17
DQ & DQM setup time to DQS (single-ended strobe)1
1 These values are for a DQ/DM slew rate of 1 V/ns and a DQS slew rate of 1 V/ns. For additional values use Table 53, “DtDS1,
DtDH1 Derating Values for DDR2-400, DDR2-533.”
tDS1(base)
0.025
—
ns
DDR18
DQ & DQM hold time to DQS (single-ended strobe)1
tDH1(base)
0.025
—
ns
DDR19
Write cycle DQS falling edge to SDCLK output setup time
tDSS
0.2
—
tCK
DDR20
Write cycle DQS falling edge to SDCLK output hold time
tDSH
0.2
—
tCK
DDR21
DQS latching rising transitions to associated clock edges
tDQSS
-0.25
0.25
tCK
DDR22
DQS high-level width
tDQSH
0.35
—
tCK
DDR23
DQS low-level width
tDQSL
0.35
—
tCK
Table 53.
ΔtDS1, ΔtDH1 Derating Values for DDR2-400, DDR2-5331,2,3
DQS Single-Ended Slew Rate
2.0 V/ns
1.5 V/ns
1.0 V/ns
0.9 V/ns
0.8 V/ns
0.7 V/ns
0.6 V/ns
0.5 Vns
0.4 V/ns
ΔtD
S1
ΔtD
H1
ΔtD
S1
ΔtD
H1
ΔtD
S1
ΔtD
H1
ΔtD
S1
ΔtD
H1
ΔtD
S1
ΔtD
H1
ΔtD
S1
ΔtD
H1
ΔtD
S1
ΔtD
H1
ΔtD
S1
ΔtD
H1
ΔtD
S1
ΔtD
H1
SDCLK
SDCLK_B
DQS (output)
DQ (output)
DQM (output)
Data
Data
DM
DDR17
DDR18
DDR19
DDR20
DDR21
DDR23
DDR22
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| MCIMX257CJM4A | 制造商:Freescale Semiconductor 功能描述:IC |
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