参数资料
型号: MCIMX255AJM4A
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 32-BIT, 400 MHz, MICROPROCESSOR, PBGA400
封装: 17 X 17 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, MAPBGA-400
文件页数: 90/140页
文件大小: 1416K
代理商: MCIMX255AJM4A
i.MX25 Applications Processor for Automotive Products, Rev. 8
Freescale Semiconductor
53
3.7.4.1
Gated Clock Mode Timing
Figure 20 and Figure 21 shows the gated clock mode timings for CSI, and Table 41 describes the timing
parameters (P1–P7) shown in the figures. A frame starts with a rising/falling edge on VSYNC, then
HSYNC is asserted and holds for the entire line. The pixel clock is valid as long as HSYNC is asserted.
Figure 20. CSI Gated Clock Mode—Sensor Data at Falling Edge, Latch Data at Rising Edge
Figure 21. CSI Gated Clock Mode—Sensor Data at Rising Edge, Latch Data at Falling Edge
PIXCLK
VSYNC
DATA[15:0]
P5
P1
P3
P4
HSYNC
P2
P6
P7
PIXCLK
VSYNC
DATA[15:0]
P6
P1
P3
P4
HSYNC
P2
P5
P7
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