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参数资料
| 型号： | MCIMX27VJP4AR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 107/152页 |
| 文件大小： | 0K |
| 描述： | IC MPU IMX27 404TMAP |
| 标准包装： | 1,000 |
| 系列： | i.MX27 |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 400MHz |
| 连通性： | 1 线，CAN，EBI/EMI，以太网，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，LCD，POR，PWM，WDT |
| 程序存储器类型： | ROMless |
| RAM 容量： | 45K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.38 V ~ 1.52 V |
| 振荡器型： | 外部 |
| 工作温度： | -20°C ~ 85°C |
| 封装/外壳： | 404-LFBGA |
| 包装： | 带卷 (TR) |
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i.MX27 and i.MX27L Data Sheet, Rev. 1.8
58
Freescale Semiconductor
Electrical Characteristics
4.3.2.2
MII Transmit Signal Timing (FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER,
and FEC_TX_CLK)
The transmitter functions correctly up to a FEC_TX_CLK maximum frequency of 25 MHz + 1%. There
is no minimum frequency requirement. In addition, the FEC IPG clock frequency must exceed twice the
FEC_TX_CLK frequency.
Figure 18. MII Transmit Signal Timing Diagram
M4
FEC_RX_CLK pulse width low
35%
65%
FEC_RX_CLK period
Note:
1
FEC_RX_DV, FEC_RX_CLK, and FEC_RXD0 have the same timing in 10 Mbps 7-wire interface mode.
Table 26. MII Transmit Signal Timing Parameters
ID
Parameter1
1
FEC_TX_EN, FEC_TX_CLK, and FEC_TXD0 have the same timing in 10 Mbps 7-wire interface mode.
Min
Max
Unit
M5
FEC_TX_CLK to FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER invalid
5
—
ns
M6
FEC_TX_CLK to FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER valid
—
20
ns
M7
FEC_TX_CLK pulse width high
35%
65%
FEC_TX_CLK period
M8
FEC_TX_CLK pulse width low
35%
65%
FEC_TX_CLK period
Note:
Table 25. MII Receive Signal Timing Parameters (continued)
ID
Parameter1
Min
Max
Unit
FEC_TX_CLK (input)
FEC_TXD[3:0] (outputs)
FEC_TX_EN
FEC_TX_ER
M7
M8
M5
M6
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PDF描述 |
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参数描述 |
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| MCIMX27VOP4R2 | 制造商:Freescale Semiconductor 功能描述:MULTIMEDIA PROCESSOR 404-PIN MA-BGA T/R - Tape and Reel |
| MCIMX27WPDK | 功能描述:开发板和工具包 - ARM MCIMX27 PDK For WINCE RoHS:否 制造商:Arduino 产品:Development Boards 工具用于评估:ATSAM3X8EA-AU 核心:ARM Cortex M3 接口类型:DAC, ICSP, JTAG, UART, USB 工作电源电压:3.3 V |
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