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参数资料
| 型号： | MCIMX31VMN5CR2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 532 MHz, MICROPROCESSOR, PBGA473 |
| 封装： | 19 X 19 MM, 0.80 MM PITCH, ROHS COMPLIANT, MAPBGA-473 |
| 文件页数： | 98/122页 |
| 文件大小： | 1418K |
| 代理商： | MCIMX31VMN5CR2 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页当前第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页
Electrical Characteristics
MCIMX31/MCIMX31L Technical Data, Rev. 4.1
Freescale Semiconductor
77
IP36 Controls hold time for write
Tdchw
Tdicpw–Tdicdw–1.5
Tdicpw–Tdicdw
—
ns
IP37 Slave device data delay8
Tracc
0
—
Tdrp9–Tlbd10–Tdicur–1.5
ns
IP38 Slave device data hold time8
Troh
Tdrp–Tlbd–Tdicdr+1.5
—
Tdicpr–Tdicdr–1.5
ns
IP39 Write data setup time
Tds
Tdicdw–1.5
Tdicdw
—
ns
IP40 Write data hold time
Tdh
Tdicpw–Tdicdw–1.5
Tdicpw–Tdicdw
—
ns
IP41 Read period2
Tdicpr
Tdicpr–1.5
Tdicpr
Tdicpr+1.5
ns
IP42 Write period3
Tdicpw
Tdicpw–1.5
Tdicpw
Tdicpw+1.5
ns
IP43 Read down time4
Tdicdr
Tdicdr–1.5
Tdicdr
Tdicdr+1.5
ns
IP44 Read up time5
Tdicur
Tdicur–1.5
Tdicur
Tdicur+1.5
ns
IP45 Write down time6
Tdicdw
Tdicdw–1.5
Tdicdw
Tdicdw+1.5
ns
IP46 Write up time7
Tdicuw
Tdicuw–1.5
Tdicuw
Tdicuw+1.5
ns
IP47 Read time point9
Tdrp
Tdrp–1.5
Tdrp
Tdrp+1.5
ns
1The exact conditions have not been finalized, but will likely match the current customer requirement for their specific display. These
conditions may be device specific.
2 Display interface clock period value for read:
3 Display interface clock period value for write:
4 Display interface clock down time for read:
5 Display interface clock up time for read:
6 Display interface clock down time for write:
7 Display interface clock up time for write:
8 This parameter is a requirement to the display connected to the IPU
9 Data read point
10 Loopback delay Tlbd is the cumulative propagation delay of read controls and read data. It includes an IPU output delay, a
device-level output delay, board delays, a device-level input delay, an IPU input delay. This value is device specific.
Table 50. Asynchronous Parallel Interface Timing Parameters—Access Level (continued)
ID
Parameter
Symbol
Min.
Typ.1
Max.
Units
Tdicpr
T
HSP_CLK
ceil
DISP#_IF_CLK_PER_RD
HSP_CLK_PERIOD
----------------------------------------------------------------
=
Tdicpw
T
HSP_CLK
ceil
DISP#_IF_CLK_PER_WR
HSP_CLK_PERIOD
------------------------------------------------------------------
=
Tdicdr
1
2
--- T
HSP_CLK
ceil
2 DISP#_IF_CLK_DOWN_RD
HSP_CLK_PERIOD
-------------------------------------------------------------------------------
=
Tdicur
1
2
--- T
HSP_CLK
ceil
2 DISP#_IF_CLK_UP_RD
HSP_CLK_PERIOD
--------------------------------------------------------------------
=
Tdicdw
1
2
--- T
HSP_CLK
ceil
2 DISP#_IF_CLK_DOWN_WR
HSP_CLK_PERIOD
---------------------------------------------------------------------------------
=
Tdicuw
1
2
--- T
HSP_CLK
ceil
2 DISP#_IF_CLK_UP_WR
HSP_CLK_PERIOD
----------------------------------------------------------------------
=
Tdrp
T
HSP_CLK
ceil
DISP#_READ_EN
HSP_CLK_PERIOD
--------------------------------------------------
=
Because
of
an
order
from
the
United
States
International
Trade
Commission,
BGA-packaged
product
lines
and
part
numbers
indicated
here
currently
are
not
available
from
Freescale
for
import
or
sale
in
the
United
States
prior
to
September
2010:
i.MX31
Product
Family
相关PDF资料 |
PDF描述 |
|---|---|
| MB95F108ANSPMC1 | 16-BIT, FLASH, 16.25 MHz, RISC MICROCONTROLLER, PQFP64 |
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| MC9S08AC96CFGE | 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP44 |
| MPC8572CVTATLB | 32-BIT, 1200 MHz, MICROPROCESSOR, PBGA1023 |
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相关代理商/技术参数 |
参数描述 |
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