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参数资料
| 型号： | MCIMX356AJM5B |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 109/147页 |
| 文件大小： | 0K |
| 描述： | IC MPU IMX35 ARM11 400MAPBGA |
| 标准包装： | 90 |
| 系列： | i.MX35 |
| 核心处理器： | ARM11 |
| 芯体尺寸： | 32-位 |
| 速度： | 532MHz |
| 连通性： | 1 线，CAN，EBI/EMI，以太网，I²C，MMC，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 96 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 128K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.33 V ~ 1.47 V |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 400-LFBGA |
| 包装： | 托盘 |
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i.MX35 Applications Processors for Automotive Products, Rev. 10
Freescale Semiconductor
64
Figure 41. MII Asynch Inputs Timing Diagram
4.9.8.5
MII Serial Management Channel Timing
Serial management channel timing is accomplished using FEC_MDIO and FEC_MDC. The FEC
functions correctly with a maximum MDC frequency of 2.5 MHz. Table 51 lists MII serial management
channel timings.
The MDC frequency should be equal to or less than 2.5 MHz to be compliant with the IEEE 802.3 MII
specification. However the FEC can function correctly with a maximum MDC frequency of 15 MHz.
Table 51. MII Transmit Signal Timing
Num
Characteristic
Min.
Max.
Units
M10
FEC_MDC falling edge to FEC_MDIO output invalid (minimum
propagation delay)
0—
ns
M11
FEC_MDC falling edge to FEC_MDIO output valid (max.
propagation delay)
—5
ns
M12
FEC_MDIO (input) to FEC_MDC rising edge setup
18
—
ns
M13
FEC_MDIO (input) to FEC_MDC rising edge hold
0
—
ns
M14
FEC_MDC pulse width high
40%
60%
FEC_MDC period
M15
FEC_MDC pulse width low
40%
60%
FEC_MDC period
FEC_CRS, FEC_COL
M9
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| MCIMX356AJQ5C | 制造商:Freescale Semiconductor 功能描述:; LEADED PROCESS COMPATIBLE:YES; PEAK RE |
| MCIMX356AJQ5CR2 | 功能描述:处理器 - 专门应用 RINGO MX35 TO2.1 RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
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