参数资料
| 型号： | MCIMX515DJZK8C |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 188/202页 |
| 文件大小： | 0K |
| 描述： | IC MPU I.MX51 527MAPBGA |
| 标准包装： | 160 |
| 系列： | i.MX51 |
| 核心处理器： | ARM? Cortex?-A8 |
| 芯体尺寸： | 32-位 |
| 速度： | 800MHz |
| 连通性： | 1 线，EBI/EMI，以太网，I²C，IrDA，MMC，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 128 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 128K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 0.8 V ~ 1.15 V |
| 振荡器型： | 外部 |
| 工作温度： | -20°C ~ 85°C |
| 封装/外壳： | 527-TFBGA |
| 包装： | 托盘 |
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i.MX51 Applications Processors for Consumer and Industrial Products, Rev. 6
86
Freescale Semiconductor
Electrical Characteristics
4.7.8
Image Processing Unit (IPU) Module Parameters
The purpose of the IPU is to provide comprehensive support for the flow of data from an image sensor
and/or to a display device. This support covers all aspects of these activities:
Connectivity to relevant devices—cameras, displays, graphics accelerators, and TV encoders.
Related image processing and manipulation: display processing, image conversions, and other
related functions.
Synchronization and control capabilities such as avoidance of tearing artifacts.
4.7.8.1
Sensor Interface Timings
There are three camera timing modes supported by the IPU.
4.7.8.1.1
BT.656 and BT.1120 Video Mode
Smart camera sensors, which include imaging processing, usually support video mode transfer. They use
an embedded timing syntax to replace the SENSB_VSYNC and SENSB_HSYNC signals. The timing
syntax is defined by the BT.656/BT.1120 standards.
This operation mode follows the recommendations of ITU BT.656/ ITU BT.1120 specifications. The only
control signal used is SENSB_PIX_CLK. Start-of-frame and active-line signals are embedded in the data
stream. An active line starts with a SAV code and ends with a EAV code. In some cases, digital blanking
is inserted in between EAV and SAV code. The CSI decodes and filters out the timing-coding from the data
stream, thus recovering SENSB_VSYNC and SENSB_HSYNC signals for internal use. On BT.656 one
component per cycle is received over the SENSB_DATA bus. On BT.1120 two components per cycle are
received over the SENSB_DATA bus.
4.7.8.1.2
Gated Clock Mode
The SENSB_VSYNC, SENSB_HSYNC, and SENSB_PIX_CLK signals are used in this mode. See
Figure 50. Gated Clock Mode Timing Diagram
SENSB_VSYNC
SENSB_HSYNC
SENSB_PIX_CLK
SENSB_DATA[19:0]
invalid
1st byte
n+1th frame
invalid
1st byte
nth frame
Active Line
Start of Frame
相关PDF资料 |
PDF描述 |
|---|---|
| MCIMX537CVV8B | MULTIMEDIA PROC 529-TEPBGA |
| MCP2003-E/MD | TXRX LIN BUS BIDIRECT 8DFN |
| MCP201T-I/SN | IC LIN TXRX ON-BOARD VREG 8SOIC |
| MCP2021A-330E/MD | IC TXRX LIN 3.3V LDO 8-DFN |
| MCP2022PT-500E/ST | IC TXRX LIN ON-BOARD VREG 14TSSO |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MCIMX515DVK8B | 制造商:Freescale Semiconductor 功能描述: |
| MCIMX515DVK8C | 功能描述:处理器 - 专门应用 ELVIS 3.0 RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| MCIMX515DVM8B | 制造商:Freescale Semiconductor 功能描述:APPLICATIONS PROCESSOR TRAY - Bulk |
| MCIMX516AJM6C | 功能描述:处理器 - 专门应用 ELVIS 3.0 RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| MCIMX516AJM6CR2 | 制造商:Freescale Semiconductor 功能描述:ELVIS 3.0 AUTO NO MV - Tape and Reel |
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