参数资料
| 型号： | MCIMX515DJZK8C |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 189/202页 |
| 文件大小： | 0K |
| 描述： | IC MPU I.MX51 527MAPBGA |
| 标准包装： | 160 |
| 系列： | i.MX51 |
| 核心处理器： | ARM? Cortex?-A8 |
| 芯体尺寸： | 32-位 |
| 速度： | 800MHz |
| 连通性： | 1 线，EBI/EMI，以太网，I²C，IrDA，MMC，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 128 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 128K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 0.8 V ~ 1.15 V |
| 振荡器型： | 外部 |
| 工作温度： | -20°C ~ 85°C |
| 封装/外壳： | 527-TFBGA |
| 包装： | 托盘 |
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Electrical Characteristics
i.MX51 Applications Processors for Consumer and Industrial Products, Rev. 6
Freescale Semiconductor
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A frame starts with a rising edge on SENSB_VSYNC (all the timings correspond to straight polarity of the
corresponding signals). Then SENSB_HSYNC goes to high and hold for the entire line. Pixel clock is valid
as long as SENSB_HSYNC is high. Data is latched at the rising edge of the valid pixel clocks.
SENSB_HSYNC goes to low at the end of line. Pixel clocks then become invalid and the CSI stops
receiving data from the stream. For next line the SENSB_HSYNC timing repeats. For next frame the
SENSB_VSYNC timing repeats.
4.7.8.1.3
Non-Gated Clock Mode
The timing is the same as the gated-clock mode (described in Section 4.7.8.1.2, “Gated Clock Mode”),
except for the SENSB_HSYNC signal, which is not used. See Figure 51. All incoming pixel clocks are
valid and cause data to be latched into the input FIFO. The SENSB_PIX_CLK signal is inactive (states
low) until valid data is going to be transmitted over the bus.
Figure 51. Non-Gated Clock Mode Timing Diagram
The timing described in Figure 51 is that of a typical sensor. Some other sensors may have a slightly
different timing. The CSI can be programmed to support rising/falling-edge triggered SENSB_VSYNC;
active-high/low SENSB_HSYNC; and rising/falling-edge triggered SENSB_PIX_CLK.
4.7.8.2
Electrical Characteristics
Figure 52 shows the sensor interface timing diagram. SENSB_PIX_CLK signal described here is not
generated by the IPU. Table 78 shows the timing characteristics for the diagram shown in Figure 52.
Figure 52. Sensor Interface Timing Diagram
SENSB_VSYNC
SENSB_PIX_CLK
SENSB_DATA[19:0]
invalid
1st byte
n+1th frame
invalid
1st byte
nth frame
Start of Frame
IP3
SENSB_DATA,
SENSB_VSYNC,
IP2
1/IP1
SENSB_PIX_CLK
(Sensor Output)
SENSB_HSYNC
相关PDF资料 |
PDF描述 |
|---|---|
| MCIMX537CVV8B | MULTIMEDIA PROC 529-TEPBGA |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MCIMX515DVK8B | 制造商:Freescale Semiconductor 功能描述: |
| MCIMX515DVK8C | 功能描述:处理器 - 专门应用 ELVIS 3.0 RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| MCIMX515DVM8B | 制造商:Freescale Semiconductor 功能描述:APPLICATIONS PROCESSOR TRAY - Bulk |
| MCIMX516AJM6C | 功能描述:处理器 - 专门应用 ELVIS 3.0 RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| MCIMX516AJM6CR2 | 制造商:Freescale Semiconductor 功能描述:ELVIS 3.0 AUTO NO MV - Tape and Reel |
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