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参数资料
| 型号： | MK2069-03GITR |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 160 MHz, OTHER CLOCK GENERATOR, PDSO56 |
| 封装： | 6.10 MM, 0.50 MM PITCH, TSSOP-56 |
| 文件页数： | 10/19页 |
| 文件大小： | 339K |
| 代理商： | MK2069-03GITR |
VCXO-Based Clock Translator with High Multiplication
MDS 2069-03
J
18
Revision 030906
Integrated Circuit Systems, Inc. l 525 Race Street, San Jose, CA 95126 l tel (408) 295-9800 l
MK2069-03
Note 1: This is the recommended crystal operating range. A crystal as low as 8 MHz can be used, although
this may result in increased output phase noise.
Note 2: The VCXO crystal will be pulled to its minimum frequency when there is no input clock (CLR = 1)
due to the attempt of the PLL to lock to 0 Hz.
Note 3: The minimum practical phase detector frequency is is assumed to be 1 kHz. Through proper loop
filter design lower input frequencies may be possible. Input frequencies as low as 400Hz have been
implemented.
Note 4: The output of RCLK is a positive pulse with a duration equal to VCLK high time, or half the VCLK
period.
Note 5: Referenced to ICLK, the skews of VCLK, RCLK and TCLK increase together when leakage is
present in the external VCXO PLL loop filter.
Output Rise Time, TCLK
tOR
0.8 to 2.0V, CL=15pF
0.75
1
ns
Output Fall Time, TCLK
tOF
2.0 to 0.8V, CL=15pF
0.75
1
ns
Skew, ICLK to VCLK (Note 5)
tIV
Rising edges, CL=15pF
-5
2.5
+10
ns
Skew, ICLK to RCLK (Note 5)
tIV
Rising edges, CL=15pF
+5
10
+20
ns
Skew, ICLK to TCLK (Note 5)
tVT
Rising edges, CL=15pF
-5
1.5
+10
ns
Nominal Output Impedance
ZOUT
20
Parameter
Symbol
Conditions
Min.
Typ.
Max. Units
相关PDF资料 |
PDF描述 |
|---|---|
| MK2069-04GITR | 160 MHz, OTHER CLOCK GENERATOR, PDSO56 |
| MK2069-04GI | 160 MHz, OTHER CLOCK GENERATOR, PDSO56 |
| MK20DN512ZVLL10 | RISC MICROCONTROLLER, PQFP100 |
| MK20DN512ZVLQ10 | 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PQFP144 |
| MK20DX128ZVMD10 | 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PBGA144 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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