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参数资料
| 型号： | MPC5123VY300BR |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | RISC PROCESSOR, PBGA516 |
| 封装： | 27 X 27 MM, 2.25 MM HEIGHT, 1 MM PITCH, ROHS COMPLIANT, PLASTIC, TFBGA-516 |
| 文件页数： | 60/86页 |
| 文件大小： | 719K |
| 代理商： | MPC5123VY300BR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页当前第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页
Electrical and Thermal Characteristics
MPC5121E/MPC5123 Data Sheet, Rev. 3
Freescale Semiconductor
63
The DELTA_X and DELTA_Y parameters are programmed via the DISP_SIZE register; The PW_H, BP_H, and FP_H
parameters are programmed via the HSYN_PARA register; And the PW_V, BP_V and FP_V parameters are programmed via
the VSYN_PARA register. See appropriate section in the reference manual for detailed descriptions on these parameters.
Figure 43 depicts the synchronous display interface timing for access level, and Table 38 lists the timing parameters.
Figure 43. LCD Interface Timing Diagram – Access Level
tFPH
HSYNC Front Porch Width
FP_H * tPCP
ns
A15.4
tSW
Screen Width
DELTA_X * tPCP
ns
A15.5
tHSP
HSYNC (Line) Period
(PW_H + BP_H + DELTA_X + FP_H) * tPCP
ns
A15.6
tPWV
VSYNC Pulse Width
PW_V * tHSP
ns
A15.7
tBPV
VSYNC Back Porch Width
BP_V * tHSP
ns
A15.8
tFPV
VSYNC Front Porch Width
FP_V * tHSP
ns
A15.9
tSH
Screen Height
DELTA_Y * tHSP
ns
A15.10
tVSP
VSYNC (Frame) Period
(PW_V + BP_V + DELTA_Y + FP_H) * tHSP
ns
A15.11
1
Display interface pixel clock period immediate value (in nanosecond).
Table 38. LCD Interface Timing Parameters – Access Level
Parameter
Description
Min
Typ
Max
Unit
SpecID
tCKH
LCD Interface Pixel Clock High Time
tPCP * 0.4
tPCP * 0.5
tPCP * 0.6
ns
A15.12
tCKL
LCD Interface Pixel Clock Low Time
tPCP * 0.4
tPCP * 0.5
tPCP * 0.6
ns
A15.13
tDSU
LCD Interface Data Setup Time
5.0
-
ns
A15.14
tDHD
LCD Interface Data Hold Time
6.0
-
ns
A15.15
tCSU
LCD Interface Control Signal Setup Time
5.0
-
ns
A15.16
tCHD
LCD Interface Control Signal Hold Time
6.0
-
ns
A15.17
Table 37. LCD Interface Timing Parameters – Pixel Level (continued)
Name
Description
Value
Unit
SpecID
tCKH
tCKL
tDHD
tDSU
tCSU
DIU_HSYNC
DIU_VSYNC
DIU_DE
DIU_CLK
DIU_LD[23:0]
tCHD
相关PDF资料 |
PDF描述 |
|---|---|
| SPC5121YVY400BR | RISC PROCESSOR, PBGA516 |
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| MPC7410RX550PE | 32-BIT, 550 MHz, RISC PROCESSOR, CBGA360 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MPC5123VY400B | 功能描述:微处理器 - MPU TELEMATICS PROCESSOR RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
| MPC5123VY400BR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:e300 Power Architecture processor core |
| MPC5123YVY300B | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Advance Information |
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