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参数资料
| 型号： | MPC5534MZQ80 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 13/60页 |
| 文件大小： | 0K |
| 描述： | MCU 1MB FLASH 80MHZ 324-PBGA |
| 标准包装： | 60 |
| 系列： | MPC55xx Qorivva |
| 核心处理器： | e200z6 |
| 芯体尺寸： | 32-位 |
| 速度： | 80MHz |
| 连通性： | CAN，EBI/EMI，以太网，SCI，SPI |
| 外围设备： | DMA，POR，PWM，WDT |
| 输入/输出数： | 192 |
| 程序存储器容量： | 1MB（1M x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 64K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.35 V ~ 1.65 V |
| 数据转换器： | A/D 40x12b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 324-BBGA |
| 包装： | 托盘 |
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MPC5534 Microcontroller Data Sheet, Rev. 6
Electrical Characteristics
Freescale Semiconductor
20
3.9
Oscillator and FMPLL Electrical Characteristics
Table 12. FMPLL Electrical Specifications
(VDDSYN = 3.0–3.6 V; VSS = VSSSYN = 0.0 V; TA = TL to TH)
Spec
Characteristic
Symbol
Minimum
Maximum
Unit
1
PLL reference frequency range: 1
Crystal reference
External reference
Dual controller (1:1 mode)
fref_crystal
fref_ext
fref_1:1
8
24
20
fsys 2
MHz
2
System frequency 2
fsys
f
ICO
(MIN) 2
RFD
fMAX
3
MHz
3
System clock period
tCYC
—1
f
sys
ns
4
Loss of reference frequency 4
fLOR
100
1000
kHz
5
Self-clocked mode (SCM) frequency 5
fSCM
7.4
17.5
MHz
6
EXTAL input high voltage crystal mode 6
All other modes
[dual controller (1:1), bypass, external reference]
VIHEXT
VXTAL + 0.4 V
(VDDE5 2) + 0.4 V
—
V
7
EXTAL input low voltage crystal mode 7
All other modes
[dual controller (1:1), bypass, external reference]
VILEXT
—
VXTAL – 0.4 V
(VDDE5 2) – 0.4 V
V
8XTAL current 8
IXTAL
0.8
3
mA
9
Total on-chip stray capacitance on XTAL
CS_XTAL
—1.5
pF
10
Total on-chip stray capacitance on EXTAL
CS_EXTAL
—1.5
pF
11
Crystal manufacturer’s recommended capacitive
load
CL
Refer to crystal
specification
Refer to crystal
specification
pF
12
Discrete load capacitance to connect to EXTAL
CL_EXTAL
—
(2
C
L) – CS_EXTAL
– CPCB_EXTAL
9
pF
13
Discrete load capacitance to connect to XTAL
CL_XTAL
—
(2
C
L) – CS_XTAL
– CPCB_XTAL
pF
14
PLL lock time 10
tlpll
—
750
s
15
Dual controller (1:1) clock skew
(between CLKOUT and EXTAL) 11, 12
tskew
–2
2
ns
16
Duty cycle of reference
tDC
40
60
%
17
Frequency unLOCK range
fUL
–4.0
4.0
% fSYS
18
Frequency LOCK range
fLCK
–2.0
2.0
% fSYS
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