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参数资料
| 型号： | MPC5646CCF0CLU8R |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 80 MHz, MICROCONTROLLER, PQFP176 |
| 封装： | 24 X 24 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, LQFP-176 |
| 文件页数： | 97/115页 |
| 文件大小： | 783K |
| 代理商： | MPC5646CCF0CLU8R |
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MPC5646C Microcontroller Datasheet, Rev. 4
Preliminary—Subject to Change Without Notice
Electrical Characteristics
Freescale Semiconductor
82
4.18.2
MII Transmit Signal Timing (TXD[3:0], TX_EN, TX_ER, TX_CLK)
The transmitter functions correctly up to a TX_CLK maximum frequency of 25 MHz +1%. There is no minimum frequency
requirement. In addition, the system clock frequency must exceed four times the TX_CLK frequency in 2:1 mode and two times
the TX_CLK frequency in 1:1 mode.
The transmit outputs (TXD[3:0], TX_EN, TX_ER) can be programmed to transition from either the rising or falling edge of
TX_CLK, and the timing is the same in either case. This options allows the use of non-compliant MII PHYs.
Refer to the Fast Ethernet Controller (FEC) chapter of the MPC5646C Reference Manual for details of this option and how to
enable it.
Figure 22. MII transmit signal timing diagram
4.18.3
MII Async Inputs Signal Timing (CRS and COL)
Table 45. MII transmit signal timing1
1 Output pads configured with SRE = 0b11.
Spec
Characteristic
Min
Max
Unit
M5
TX_CLK to TXD[3:0],
TX_EN, TX_ER
invalid
5—
ns
M6
TX_CLK to TXD[3:0],
TX_EN, TX_ER valid
—25
ns
M7
TX_CLK pulse width
high
35%
65%
TX_CLK period
M8
TX_CLK pulse width
low
35%
65%
TX_CLK period
Table 46. MII Async Inputs Signal Timing1
1 Output pads configured with SRE = 0b11.
Spec
Characteristic
Min
Max
Unit
M9
CRS, COL minimum
pulse width
1.5
—
TX_CLK period
M6
TX_CLK (input)
TXD[3:0] (outputs)
TX_EN
TX_ER
M5
M7
M8
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