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参数资料
| 型号： | MPC8378E-MDS-PB |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 77/128页 |
| 文件大小： | 0K |
| 描述： | BOARD PROCESSOR FOR MDS S |
| 标准包装： | 1 |
| 类型： | MPU |
| 适用于相关产品： | MPC8378 |
| 所含物品： | 板 |
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MPC8378E PowerQUICC II Pro Processor Hardware Specifications, Rev. 8
52
Freescale Semiconductor
11.2.1
Full-Speed Output Path (Write)
This figure provides the data and command output timing diagram.
Figure 31. Full Speed Output Path
11.2.1.1
Full-Speed Write Meeting Setup (Maximum Delay)
The following equations show how to calculate the allowed skew range between the SD_CLK and
SD_DAT/CMD signals on the PCB.
No clock delay:
tSFSKHOV + tDATA_DELAY + tISU < tSFSCKL
Eqn. 1
With clock delay:
tSFSKHOV + tDATA_DELAY + tISU < tSFSCKL + tCLK_DELAY
Eqn. 2
tDATA_DELAY + tSFSCKL < tSFSCK + tCLK_DELAY – tISU – tSFSKHOV
Eqn. 3
This means that data can be delayed versus clock up to 11 ns in ideal case of tSFSCKL =20 ns:
tDATA_DELAY + 20 < 40 + tCLK_DELAY – 5 – 4
tDATA_DELAY < 11 + tCLK_DELAY
11.2.1.2
Full-Speed Write Meeting Hold (Minimum Delay)
The following equations show how to calculate the allowed skew range between the SD_CLK and
SD_DAT/CMD signals on the PCB.
tCLK_DELAY < tSFSCKL + tSFSKHOX + tDATA_DELAY – tIH
Eqn. 4
Input at the
MPC8378E pins
SD CLK at the
MPC8378E pin
Output valid time: tSFSKHOV
Output hold time: tSFSKHOX
tIH (5 ns)
tCLK_DELAY
SD CLK at
Driving
Edge
Sampling
edge
the card pin
tISU (5 ns)
tDATA_DELAY
tSFSCKL
tSFSCK (clock cycle)
Output from the
MPC8378E Pins
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| MPC8378EVRAFFA | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:PowerQUICC? II Pro Processor Hardware Specifications |
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| MPC8378EVRAGDA | 功能描述:微处理器 - MPU 8378 PBGA ST PbFr W/ENC RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
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