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参数资料
| 型号： | MPC8535ECVTATH |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 96/126页 |
| 文件大小： | 0K |
| 描述： | MCU PWRQUICC II 1250MHZ 783-PBGA |
| 标准包装： | 1 |
| 系列： | MPC85xx |
| 处理器类型： | 32-位 MPC85xx PowerQUICC III |
| 速度： | 1.25GHz |
| 电压： | 1V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 783-BBGA，FCBGA |
| 供应商设备封装： | 783-FCPBGA（29x29） |
| 包装： | 托盘 |
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Electrical Characteristics
MPC8535E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 5
Freescale Semiconductor
71
Figure 40. Local Bus Signals (PLL Bypass Mode)
This table describes the general timing parameters of the local bus interface at VDD = 3.3 V DC with PLL disabled.
Table 54. Local Bus General Timing Parameters—PLL Bypassed
Parameter
Symbol 1
Min
Max
Unit
Notes
Local bus cycle time
tLBK
12
—
ns
2
Local bus duty cycle
tLBKH/tLBK
43
57
%
—
Input setup to local bus clock (except LUPWAIT)
tLBIVKH1
5.1
—
ns
4, 5
LUPWAIT input setup to local bus clock
tLBIVKL2
4.2
—
ns
4, 5
Input hold from local bus clock (except LUPWAIT)
tLBIXKH1
-1.4
—
ns
4, 5
LUPWAIT input hold from local bus clock
tLBIXKL2
-2.0
—
ns
4, 5
LALE output transition to LAD/LDP output transition (LATCH hold time)
tLBOTOT
1.4
—
ns
6
Local bus clock to output valid (except LAD/LDP and LALE)
tLBKLOV1
—0.5
ns
4
Output Signals:
LA[27:31]/LBCTL/LOE
tLBKLOV2
LCLK[n]
Input Signals:
LAD[0:31]/LDP[0:3]
Output (Data) Signals:
LAD[0:31]/LDP[0:3]
LALE
tLBIXKH1
Input Signal:
LGTA
Output (Address) Signal:
LAD[0:31]
tLBIVKH1
tLBKLOX1
tLBKLOZ2
tLBOTOT
tLBKLOX2
tLBKLOV1
tLBKLOV3
tLBKLOZ1
tLBKLOV4
tLBIXKL2
tLBIVKL2
UPM Mode Input Signal:
LUPWAIT
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PDF描述 |
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参数描述 |
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