参数资料
型号: MPC8560PX833FB
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 32-BIT, 883 MHz, RISC PROCESSOR, PBGA783
封装: 29 X 29 MM, 3.75 MM HEIGHT, 1 MM PITCH, FLIP CHIP, PLASTIC, BGA-783
文件页数: 37/108页
文件大小: 1379K
代理商: MPC8560PX833FB
MPC8560 Integrated Processor Hardware Specifications, Rev. 4
34
Freescale Semiconductor
Local Bus
8.2 Local Bus AC Electrical Specifications
Table 31 describes the general timing parameters of the local bus interface of the MPC8560 with the DLL
enabled.
Table 31. Local Bus General Timing Parameters - DLL Enabled
Parameter
POR Configuration
Symbol 1
Min
Max
Unit
Notes
Local bus cycle time
tLBK
6.0
ns
2
LCLK[n] skew to LCLK[m] or
LSYNC_OUT
tLBKSKEW
150
ps
3, 9
Input setup to local bus clock
(except LUPWAIT)
tLBIVKH1
1.8
ns
4, 5, 8
LUPWAIT input setup to local bus
clock
tLBIVKH2
1.7
ns
4, 5
Input hold from local bus clock
(except LUPWAIT)
tLBIXKH1
0.5
ns
4, 5, 8
LUPWAIT input hold from local bus
clock
tLBIXKH2
1.0
ns
4, 5
LALE output transition to LAD/LDP
output transition (LATCH hold time)
tLBOTOT
1.5
ns
6
Local bus clock to output valid
(except LAD/LDP and LALE)
TSEC2_TXD[6:5] = 00
tLBKHOV1
2.0
ns
4, 8
TSEC2_TXD[6:5] = 11
(default)
3.5
Local bus clock to data valid for
LAD/LDP
TSEC2_TXD[6:5] = 00
tLBKHOV2
2.2
ns
4, 8
TSEC2_TXD[6:5] = 11
(default)
3.7
Local bus clock to address valid for
LAD
TSEC2_TXD[6:5] = 00
tLBKHOV3
2.3
ns
4, 8
TSEC2_TXD[6:5] = 11
(default)
3.8
Local bus clock to LALE assertion
tLBKHOV4
2.3
ns
4, 8
Output hold from local bus clock
(except LAD/LDP and LALE)
TSEC2_TXD[6:5] = 00
tLBKHOX1
0.7
ns
4, 8
TSEC2_TXD[6:5] = 11
(default)
1.6
Output hold from local bus clock for
LAD/LDP
TSEC2_TXD[6:5] = 00
tLBKHOX2
0.7
ns
4, 8
TSEC2_TXD[6:5] = 11
(default)
1.6
Local bus clock to output high
Impedance (except LAD/LDP and
LALE)
TSEC2_TXD[6:5] = 00
tLBKHOZ1
2.5
ns
7, 9
TSEC2_TXD[6:5] = 11
(default)
3.8
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