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参数资料
| 型号： | MPC8572ECVTAVNE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 93/138页 |
| 文件大小： | 0K |
| 描述： | MPU POWERQUICC III 1023FCPBGA |
| 标准包装： | 1 |
| 系列： | MPC85xx |
| 处理器类型： | 32-位 MPC85xx PowerQUICC III |
| 速度： | 1.5GHz |
| 电压： | 1.1V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 1023-BBGA，FCBGA |
| 供应商设备封装： | 1023-FCPBGA（33x33） |
| 包装： | 托盘 |
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MPC8572E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 5
58
Freescale Semiconductor
Local Bus Controller (eLBC)
Figure 30. Local Bus Signals, Non-Special Signals Only (PLL Enabled)
Table 52 describes the general timing parameters of the local bus interface at BVDD = 3.3 V DC with PLL
disabled.
Table 52. Local Bus General Timing Parameters—PLL Bypassed
At recommended operating conditions with BVDD of 3.3 V ± 5%
Parameter
Symbol 1
Min
Max
Unit
Notes
Local bus cycle time
tLBK
12
—
ns
2
Local bus duty cycle
tLBKH/tLBK
43
57
%
—
Internal launch/capture clock to LCLK delay
tLBKHKT
2.3
4.0
ns
—
Input setup to local bus clock (except
LGTA/LUPWAIT)
tLBIVKH1
5.8
—
ns
4, 5
LGTA/LUPWAIT input setup to local bus clock
tLBIVKL2
5.7
—
ns
4, 5
Input hold from local bus clock (except
LGTA/LUPWAIT)
tLBIXKH1
-1.3
—
ns
4, 5
LGTA/LUPWAIT input hold from local bus clock
tLBIXKL2
-1.3
—
ns
4, 5
Output Signals:
LA[27:31]/LCS[0:7]/LWE[0:3]/
LFWE/LBCTL/LFCLE/
LFALE/LOE/LFRE/LFWP
tLBKHOV1
tLBKHOV2
tLBKHOV3
LSYNC_IN
Input Signals:
LAD[0:31]/LDP[0:3]
Output (Data) Signals:
LAD[0:31]/LDP[0:3]
Output (Address) Signal:
LAD[0:31]
LALE
tLBIXKH1
tLBIVKH1
tLBIVKH2
tLBIXKH2
tLBKHOX1
tLBKHOZ1
tLBKHOX2
tLBKHOZ2
Input Signal:
LGTA/LFRB
tLBOTOT
tLBKHOZ2
tLBKHOX2
tLBKHOV4
LUPWAIT
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