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参数资料
型号： MPC866PCZP100
厂商： MOTOROLA INC
元件分类： 微控制器/微处理器
英文描述： 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256
封装： 23 X 23 MM, PLASTIC, BGA-256
文件页数： 966/1358页
文件大小： 14179K
代理商： MPC866PCZP100
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MOTOROLA
Chapter 21. Serial Communications Controllers
21-9
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
SCC Registers
14–15
TDCR
Transmitter/receiver DPLL clock rate. If the DPLL is not used, choose 1
× mode except in
asynchronous UART mode where 8
×, 16×, or 32× must be chosen. TDCR should match RDCR in
most applications to allow the transmitter and receiver to use the same clock source. If an application
uses the DPLL, the selection of TDCR/RDCR depends on the encoding/decoding. If communication
is synchronous, select 1
×. FM0/FM1, Manchester, and Differential Manchester require 8×, 16×, or
32
×. If NRZ- or NRZI-encoded communication is asynchronous (that is, clock recovery required),
select 8
×, 16×, or 32×. The 8× option allows highest speed, whereas the 32× option provides the
greatest resolution.
00 1
× clock mode. Only NRZ or NRZI encodings/decodings are allowed.
01 8
× clock mode
10 16
× clock mode. Normally chosen for UART and AppleTalk.
11 32
× clock mode
16–17
RDCR
18–20
RENC Receiver decoding/transmitter encoding method. Select NRZ if DPLL is not used. RENC should
equal TENC in most applications. However, do not use this internal DPLL for Ethernet.
000 NRZ (default setting if DPLL is not used). Required for UART (synchronous or asynchronous).
001 NRZI Mark (set RINV/TINV also for NRZI space).
010 FM0 (set RINV/TINV also for FM1).
011 Reserved
100 Manchester
101 Reserved
110 Differential Manchester (Differential Bi-phase-L)
111 Reserved
21–23
TENC
24–25
DIAG
Diagnostic mode.
00 Normal operation, CTS and CD are under automatic control. Data is received through RXD and
transmitted through TXD. The SCC uses modem signals to enable or disable transmission and
reception. These timings are shown in Section 21.4.4, “Controlling SCC Timing with RTS, CTS,
and CD.”
01 Local loopback mode. Transmitter output is connected internally to the receiver input, while the
receiver and the transmitter operate normally. The value on RXD is ignored. If enabled, data
appears on TXD, or the parallel I/O registers can be programmed to make TXD high. RTS can
also be programmed to be disabled in the appropriate parallel I/O register. The transmitter and
receiver must share the same clock source, but separate CLKx pins can be used if connected to
the same external clock source.
If external loopback is preferred, program DIAG for normal operation and externally connect TXD
and RXD. Then, physically connect the control signals (RTS connected to CD, and CTS
grounded) or set the parallel I/O registers so CD and CTS are permanently asserted to the SCC
by conguring the associated CTS and CD pins as general-purpose I/O.
10 Automatic echo mode. The transmitter automatically resends received data bit-by-bit using the
Rx clock provided. The receiver operates normally and receives data if CD is asserted. CTS is
ignored.
11 Loopback and echo mode. Loopback and echo operation occur simultaneously. CD and CTS are
ignored. See the loopback bit description above for clocking requirements.
For TDM operation, the diagnostic mode is selected by SIMODE[SDMx]; see Section 20.2.4.2, “SI
Mode Register (SIMODE).”
26
ENR
Enable receive. Enables the receiver hardware state machine for the SCC.
0 The receiver is disabled and data in the Rx FIFO is lost. If ENR is cleared during reception, the
receiver aborts the current character.
1 The receiver is enabled.
ENR can be set or cleared, regardless of whether serial clocks are present. Section 21.4.7,
“Reconguring the SCCs,” describes how to disable/enable the SCCs. Note also these other tools
provided for controlling SCC reception: the ENTER HUNT MODE and CLOSE RXBD commands, and
RxBD[E].
Table 21-3. GSMR_L Field Descriptions (continued)
Bits
Name
Description
相关PDF资料
PDF描述
MPC866TCZP100 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256
MPC866TZP133A 32-BIT, 133 MHz, RISC PROCESSOR, PBGA357
MPC866PZP133A 32-BIT, 133 MHz, RISC PROCESSOR, PBGA357
MPC9229EI 400 MHz, OTHER CLOCK GENERATOR, PQCC28
MPC9229FN 400 MHz, OTHER CLOCK GENERATOR, PQCC28
相关代理商/技术参数
参数描述
MPC866PCZP100A 功能描述:微处理器 - MPU POWER QUICC I HIP6W RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324
MPC866PVR100A 功能描述:微处理器 - MPU PQ I HIP6W NO-PB RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324
MPC866PVR133A 功能描述:微处理器 - MPU PQ I HIP6W NO-PB RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324
MPC866PZP100 制造商:Rochester Electronics LLC 功能描述:- Bulk
MPC866PZP100A 功能描述:微处理器 - MPU POWER QUICC I HIP6W RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324
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