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参数资料
型号： MPC9352AC
厂商： IDT, Integrated Device Technology Inc
文件页数： 16/16页
文件大小： 0K
描述： IC CLK GEN ZD 1:11 32-LQFP
标准包装： 250
类型： PLL 时钟发生器
PLL： 带旁路
输入： LVCMOS
输出： LVCMOS
电路数： 1
比率 - 输入:输出： 1:11
差分 - 输入:输出： 无/无
频率 - 最大： 200MHz
除法器/乘法器： 是/是
电源电压： 2.375 V ~ 3.465 V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 32-LQFP
供应商设备封装： 32-TQFP（7x7）
包装： 托盘
MPC9352 REVISION 8 JANUARY 31, 2013
9
2013 Integrated Device Technology, Inc.
MPC9353 Data Sheet
3.3V/2.5V 1:11 LVCMOS ZERO DELAY CLOCK GENERATOR
MPC9352 configuration to multiply the reference
frequency by 3, 3
2 and 1. PLL feedback of
QA4 = 33.3 MHz.
Figure 4. MPC9352 Zero Delay Buffer Configuration
Figure 5. MPC9352 Default Configuration
Figure 6. MPC9352 Zero Delay Buffer
Configuration 2
MPC9352
fref = 100 MHz
100 MHz
100 MHz (Feedback)
QA0
QA1
QA2
QA3
QA4
QB0
QB1
QB2
QB3
QC0
QC1
CCLK
FB_IN
FSELA
FSELB
FSELD
F_RANGE
200 MHz
MPC9352 default configuration (feedback of QB0 = 100 MHz).
All control pins are left open.
MPC9352
fref = 62.5 MHz
62.5 MHz
62.5 MHz (Feedback)
QA0
QA1
QA2
QA3
QA4
QB0
QB1
QB2
QB3
QC0
QC1
CCLK
FB_IN
FSELA
FSELB
FSELC
F_RANGE
62.5 MHz
MPC9352 zero-delay (feedback of QB0 = 62.5 MHz). All
control pins are left open except FSELC = 1. All outputs
are locked in frequency and phase to the input clock.
MPC9352
fref = 33.3 MHz
33.3 MHz
50 MHz
33.3 MHz (Feedback)
QA0
QA1
QA2
QA3
QA4
QB0
QB1
QB2
QB3
QC0
QC1
CCLK
FB_IN
FSELA
FSELB
FSELC
F_RANGE
100 MHz
MPC9352
fref = 33.3 MHz
33.3 MHz
33.3 MHz (Feedback)
QA0
QA1
QA2
QA3
QQ4
QB0
QB1
QB2
QB3
QC0
QC1
CCLK
FB_IN
FSELA
FSELB
FSELC
F_RANGE
33.3 MHz
MPC9352 zero-delay (feedback of QB0 = 33.3 MHz).
Equivalent to Table 2 except F_RANGE = 1 enabling a
lower input and output clock frequency.
Frequency Range
Min
Max
Input
50 MHz
100 MHz
QA outputs
50 MHz
10 MHz
QB outputs
50 MHz
100 MHz
QC outputs
100 MHz
200 MHz
Frequency Range
Min
Max
Input
50 MHz
100 MHz
QA outputs
50 MHz
10 MHz
QB outputs
50 MHz
100 MHz
QC outputs
50 MHz
100 MHz
Frequency Range
Min
Max
Input
25 MHz
50 MHz
QA outputs
50 MHz
10 MHz
QB outputs
50 MHz
100 MHz
QC outputs
100 MHz
200 MHz
Frequency Range
Min
Max
Input
25 MHz
50 MHz
QA outputs
25 MHz
50 MHz
QB outputs
25 MHz
50 MHz
QC outputs
25 MHz
50 MHz
VCC
Figure 3. MPC9352 Default Configuration
Example Configurations for the MPC9352
相关PDF资料
PDF描述
MPC93H51AC IC PLL CLK DRIVER LV 32-LQFP
MPC93H52AC IC CLK GEN ZD 1:11 32-LQFP
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MPC962309EJ-1H IC BUFFER ZD 1:5 3.3V 16-TSSOP
相关代理商/技术参数
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