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参数资料
| 型号： | MSC1210Y3PAGTG4 |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 33 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | GREEN, PLASTIC, TQFP-64 |
| 文件页数： | 79/94页 |
| 文件大小： | 913K |
| 代理商： | MSC1210Y3PAGTG4 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页当前第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页
MSC1210
SBAS203J MARCH 2002 REVISED JANUARY 2008
www.ti.com
80
Summation Register 0 (SUMR0)
7
6
5
4
3
2
1
0
Reset Value
SFR E2h
LSB
00h
SUMR0
Summation Register 0. This is the least significant byte of the 32-bit summation register or bits 0 to 7.
bits 70
Write: Will cause values in SUMR30 to be added to the summation register.
Read: Will clear the Summation Count Interrupt. AI in EICON (SFR D8h) must also be cleared.
Summation Register 1 (SUMR1)
7
6
5
4
3
2
1
0
Reset Value
SFR E3h
00h
SUMR1
Summation Register 1. These are bits 815 of the 32-bit summation register.
bits 70
Summation Register 2 (SUMR2)
7
6
5
4
3
2
1
0
Reset Value
SFR E4h
00h
SUMR2
Summation Register 2. These are bits 1623 of the 32-bit summation register.
bits 70
Summation Register 3 (SUMR3)
7
6
5
4
3
2
1
0
Reset Value
SFR E5h
MSB
00h
SUMR3
Summation Register 3. This is the most significant byte of the 32-bit summation register or bits 2431.
bits 70
Offset DAC Register (ODAC)
7
6
5
4
3
2
1
0
Reset Value
SFR E6h
00h
ODAC
Offset DAC Register. This register will shift the input by up to half of the ADC full-scale input range. The offset DAC
bits 70
value is summed with the ADC input prior to conversion. Writing 00h or 80h to ODAC turns off the offset DAC.
bit 7
Offset DAC Sign bit.
0 = Positive
1 = Negative
bit 60
Offset
+
*V
REF
2
@ PGA @
ODAC 6: 0
127
@ (* 1)
bit7
NOTE: ODAC cannot be used to offset the input so that the buffer can be used for AGND signals. Offset DAC should be
cleared before offset calibration, since the offset DAC output is applied directly to the ADC input.
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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