- 您现在的位置：买卖IC网 > PDF目录68016 > MSC7113VM1000 (FREESCALE SEMICONDUCTOR INC) 32-BIT, 266 MHz, OTHER DSP, PBGA400 PDF资料下载
参数资料
| 型号： | MSC7113VM1000 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 32-BIT, 266 MHz, OTHER DSP, PBGA400 |
| 封装： | 17 X 17 MM, LEAD FREE, BGA-400 |
| 文件页数： | 25/60页 |
| 文件大小： | 721K |
| 代理商： | MSC7113VM1000 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页当前第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页
Electrical Characteristics
MSC7113 Data Sheet, Rev. 11
Freescale Semiconductor
31
2.5.7
HDI16 Signals
Table 25. Host Interface (HDI16) Timing1, 2
No.
Characteristics3
Mask Set 1L44X
Mask Set 1M88B
Unit
Expression
Value
Expression
Value
40
Host Interface Clock period
THCLK
Note 1
TCORE
Note 1
ns
44a Read data strobe minimum assertion width4
HACK read minimum assertion width
3.0
× THCLK
Note 11
2.0
× TCORE + 9.0 Note 11 ns
44b Read data strobe minimum deassertion width4
HACK read minimum deassertion width
1.5
× THCLK
Note 11
1.5
× TCORE
Note 11
ns
44c Read data strobe minimum deassertion width4 after “Last Data
Register” reads5,6, or between two consecutive CVR, ICR, or ISR
reads7
HACK minimum deassertion width after “Last Data Register” reads5,6
2.5
× THCLK
Note 11
2.5
× TCORE
Note 11
ns
45
Write data strobe minimum assertion width8
HACK write minimum assertion width
1.5
× THCLK
Note 11
1.5
× TCORE
Note 11
ns
46
Write data strobe minimum deassertion width8
HACK write minimum deassertion width after ICR, CVR and Data
Register writes5
2.5
× THCLK
Note 11
2.5
× TCORE
Note 11
ns
47
Host data input minimum setup time before write data strobe
deassertion8
Host data input minimum setup time before HACK write deassertion
—3.0
—2.5
ns
48
Host data input minimum hold time after write data strobe
deassertion8
Host data input minimum hold time after HACK write deassertion
—4.0
—2.5
ns
49
Read data strobe minimum assertion to output data active from high
impedance4
HACK read minimum assertion to output data active from high
impedance
—1.0
ns
50
Read data strobe maximum assertion to output data valid4
HACK read maximum assertion to output data valid
(2.0
× THCLK) + 8.0 Note 11 (2.0 × TCORE) + 8.0 Note 11 ns
51
Read data strobe maximum deassertion to output data high
impedance4
HACK read maximum deassertion to output data high impedance
—8.0
—9.0
ns
52
Output data minimum hold time after read data strobe deassertion4
Output data minimum hold time after HACK read deassertion
—
1.0
—
1.0
ns
53
HCS[1–2] minimum assertion to read data strobe assertion4
—0.0
—0.5
ns
54
HCS[1–2] minimum assertion to write data strobe assertion8
—0.0
ns
55
HCS[1–2] maximum assertion to output data valid
(2.0
× THCLK) + 8.0 Note 11 (2.0 × TCORE) + 6.0 Note 11 ns
56
HCS[1–2] minimum hold time after data strobe deassertion9
—0.0
—0.5
ns
57
HA[0–3], HRW minimum setup time before data strobe assertion9
—5.0
ns
58
HA[0–3], HRW minimum hold time after data strobe deassertion9
—5.0
ns
61
Maximum delay from read data strobe deassertion to host request
deassertion for “Last Data Register” read4, 5, 10
(3.0
× THCLK) + 8.0 Note 11 (3.0 × TCORE) + 6.0 Note 11 ns
62
Maximum delay from write data strobe deassertion to host request
deassertion for “Last Data Register” write5,8,10
(3.0
× THCLK) + 8.0 Note 11 (3.0 × TCORE) + 6.0 Note 11 ns
63
Minimum delay from DMA HACK (OAD=0) or Read/Write data
strobe(OAD=1) deassertion to HREQ assertion.
(2.0
× THCLK) + 1.0 Note 11 (2.0 × TCORE) + 1.0 Note 11 ns
64
Maximum delay from DMA HACK (OAD=0) or Read/Write data
strobe(OAD=1) assertion to HREQ deassertion
(5.0
× THCLK) + 8.0 Note 11 (5.0 × TCORE) + 6.0 Note 11 ns
Because
of
an
order
from
the
United
States
International
Trade
Commission,
BGA-packaged
product
lines
and
part
numbers
indicated
here
currently
are
not
available
from
Freescale
for
import
or
sale
in
the
United
States
prior
to
September
2010:
MSC711XADS
相关PDF资料 |
PDF描述 |
|---|---|
| MSC8103M1200F | 64-BIT, 75 MHz, OTHER DSP, PBGA332 |
| MSC8103M1100F | 64-BIT, 68.75 MHz, OTHER DSP, PBGA332 |
| MSC8154SVT1000B | 0-BIT, OTHER DSP, PBGA783 |
| MSC8154TVT1000B | 0-BIT, OTHER DSP, PBGA783 |
| MSC8156ESVT1000B | 0-BIT, OTHER DSP, PBGA783 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MSC7113VM800 | 功能描述:IC DSP PROCESSOR 16BIT 400MAPBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:StarCore 标准包装:2 系列:StarCore 类型:SC140 内核 接口:DSI，以太网，RS-232 时钟速率:400MHz 非易失内存:外部 芯片上RAM:1.436MB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:-40°C ~ 105°C 安装类型:表面贴装 封装/外壳:431-BFBGA，FCBGA 供应商设备封装:431-FCPBGA（20x20） 包装:托盘 |
| MSC7115VF1000 | 功能描述:DSP 16BIT W/DDR CTRLR 400-MAPBGA RoHS:否 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:StarCore 标准包装:40 系列:TMS320DM64x, DaVinci™ 类型:定点 接口:I²C，McASP，McBSP 时钟速率:400MHz 非易失内存:外部 芯片上RAM:160kB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:0°C ~ 90°C 安装类型:表面贴装 封装/外壳:548-BBGA，FCBGA 供应商设备封装:548-FCBGA（27x27） 包装:托盘 配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA |
| MSC7115VM1000 | 功能描述:DSP 16BIT W/DDR CTRLR 400-MAPBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:StarCore 标准包装:40 系列:TMS320DM64x, DaVinci™ 类型:定点 接口:I²C，McASP，McBSP 时钟速率:400MHz 非易失内存:外部 芯片上RAM:160kB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:0°C ~ 90°C 安装类型:表面贴装 封装/外壳:548-BBGA，FCBGA 供应商设备封装:548-FCBGA（27x27） 包装:托盘 配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA |
| MSC7115VM800 | 功能描述:IC DSP PROCESSOR 16BIT 400MAPBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:StarCore 标准包装:2 系列:StarCore 类型:SC140 内核 接口:DSI，以太网，RS-232 时钟速率:400MHz 非易失内存:外部 芯片上RAM:1.436MB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:-40°C ~ 105°C 安装类型:表面贴装 封装/外壳:431-BFBGA，FCBGA 供应商设备封装:431-FCPBGA（20x20） 包装:托盘 |
| MSC7116 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Low-Cost 16-bit DSP with DDR Controller and 10/100 Mbps Ethernet MAC |
发布紧急采购，3分钟左右您将得到回复。