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参数资料
型号： MSP430F2101IDWR
厂商： TEXAS INSTRUMENTS INC
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 16 MHz, RISC MICROCONTROLLER, PDSO20
封装： GREEN, PLASTIC, SOIC-20
文件页数： 22/57页
文件大小： 1276K
代理商： MSP430F2101IDWR
MSP430x21x1
MIXED SIGNAL MICROCONTROLLER
SLAS439D -- SEPTEMBER 2004 -- REVISED SEPTEMBER 2010
29
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
electrical characteristics over recommended ranges of supply voltage and operating free-air
temperature (unless otherwise noted) (continued)
Timer_A
PARAMETER
TEST CONDITIONS
VCC
MIN
TYP
MAX UNIT
f
Timer A clock frequency
Internal: SMCLK, ACLK;
External: TACLK INCLK;
2.2 V
10
MHz
fTA
Timer_A clock frequency
External: TACLK, INCLK;
Duty Cycle = 50% ±10%
3V
16
MHz
tTA,cap
Timer_A, capture timing
TA0, TA1, TA2
2.2 V/3 V
20
ns
Comparator_A+ (see Note 1)
PARAMETER
TEST CONDITIONS
VCC
MIN
TYP
MAX
UNIT
I
CAON 1 CARSEL 0 CAREF 0
2.2 V
25
40
A
I(DD)
CAON=1, CARSEL=0, CAREF=0
3V
45
60
A
I
CAON=1, CARSEL=0,
CAREF 1/2/3 no load at
2.2 V
30
50
A
I(Refladder/RefDiode)
CAREF=1/2/3, no load at
P2.3/CA0/TA1 and P2.4/CA1/TA2
3V
45
71
A
V(IC)
Common-mode input
voltage
CAON=1
2.2 V/3 V
0
VCC--1
V
V(Ref025)
Voltage @ 0.25 VCC node
VCC
PCA0=1, CARSEL=1, CAREF=1,
No load at P2.3/CA0/TA1 and
P2.4/CA1/TA2
2.2 V/3 V
0.23
0.24
0.25
V(Ref050)
Voltage @ 0.5VCC node
VCC
PCA0=1, CARSEL=1, CAREF=2,
No load at P2.3/CA0/TA1 and
P2.4/CA1/TA2
2.2 V/3 V
0.47
0.48
0.5
V
(see Figure 19 and Figure 20)
PCA0=1, CARSEL=1, CAREF=3,
No load at P2 3/CA0/TA1 and
2.2 V
390
480
540
mV
V(RefVT)
(see Figure 19 and Figure 20)
No load at P2.3/CA0/TA1 and
P2.4/CA1/TA2, TA =85°C
3V
400
490
550
mV
V(offset)
Offset voltage
SeeNote2
2.2 V/3 V
--30
30
mV
Vhys
Input hysteresis
CAON=1
2.2 V/3 V
0
0.7
1.4
mV
TA =25°C, Overdrive 10 mV,
Without filter: CAF=0
2.2 V
80
165
300
ns
t
Response time
Without filter: CAF=0
(see Note 3, Figure 16 and
Figure 17)
3V
70
120
240
ns
t(response)
Response time
(low--high and high--low)
TA =25°C, Overdrive 10 mV,
With filter: CAF=1
2.2 V
1.4
1.9
2.8
s
With filter: CAF=1
(see Note 3, Figure 16 and
Figure 17)
3V
0.9
1.5
2.2
s
NOTES: 1. The leakage current for the Comparator_A+ terminals is identical to Ilkg(Px.x) specification.
2. The input offset voltage can be cancelled by using the CAEX bit to invert the Comparator_A+ inputs on successive measurements.
The two successive measurements are then summed together.
3. Response time measured at P2.2/CAOUT.
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