参数资料
| 型号： | NB6L11SMNG |
| 厂商： | ON Semiconductor |
| 文件页数： | 4/11页 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFFER TRANSLA 1:2 16-QFN |
| 标准包装： | 123 |
| 系列： | AnyLevel™ |
| 类型： | 扇出缓冲器（分配），变换器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 是/是 |
| 输入： | CML，LVCMOS，LVDS，LVPECL，LVTTL |
| 输出： | LVDS |
| 频率 - 最大： | 2GHz |
| 电源电压： | 2.375 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-VFQFN 裸露焊盘 |
| 供应商设备封装： | 16-QFN（3x3） |
| 包装： | 管件 |
| 产品目录页面： | 1115 (CN2011-ZH PDF) |
| 其它名称： | NB6L11SMNG-ND NB6L11SMNGOS |
NB6L11S
http://onsemi.com
2
Figure 3. NB6L11S Pinout, 16pin QFN (Top View)
VCC NC VEE VEE
VCC
VTD
D
VTD
Q0
Q1
56
7
8
16
15
14
13
12
11
10
9
1
2
3
4
NB6L11S
Exposed Pad (EP)
VCC VCC VCC
Table 1. PIN DESCRIPTION
Pin
Name
I/O
Description
1
Q0
LVDS Output
Noninverted D output. Typically loaded with 100 W receiver termination
resistor across differential pair.
2
Q0
LVDS Output
Inverted D output. Typically loaded with 100 W receiver termination resistor
across differential pair.
3
Q1
LVDS Output
Noninverted D output. Typically loaded with 100 W receiver termination
resistor across differential pair.
4
Q1
LVDS Output
Inverted D output. Typically loaded with 100 W receiver termination resistor
across differential pair.
5
VCC
Positive Supply Voltage.
6
NC
No Connect.
7
VEE
Negative Supply Voltage.
8
VEE
Negative Supply Voltage.
9
VTD
Internal 50 W termination pin for D.
10
D
LVPECL, CML, LVDS,
LVCMOS, LVTTL
Inverted Differential Clock/Data Input (Note 1).
11
D
LVPECL, CML, LVDS,
LVCMOS, LVTTL
Noninverted Differential Clock/Data Input (Note 1).
12
VTD
Internal 50 W termination pin for D.
13
VCC
Positive Supply Voltage.
14
VCC
Positive Supply Voltage.
15
VCC
Positive Supply Voltage.
16
VCC
Positive Supply Voltage.
EP
Exposed pad. The exposed pad (EP) on the package bottom must be
attached to a heatsinking conduit. The exposed pad may only be
electrically connected to VEE.
1. In the differential configuration when the input termination pins(VTD0/VTD0, VTD1/ VTD1) are connected to a common termination voltage
or left open, and if no signal is applied on D0/D0, D1/D1 input, then the device will be susceptible to selfoscillation.
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