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参数资料
| 型号： | OR3T55-4PS240 |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 324 CLBS, 40000 GATES, 80 MHz, PQFP240 |
| 封装： | SQFP-240 |
| 文件页数： | 37/210页 |
| 文件大小： | 2138K |
| 代理商： | OR3T55-4PS240 |
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Preliminary Data Sheet, Rev. 1
September 1998
ORCA Series 3 FPGAs
Lucent Technologies Inc.
131
Timing Characteristics (continued)
Note: Serial configuration data is transmitted out on DOUT on the falling edge of CCLK after it is input on DIN.
Figure 82. Slave Serial Configuration Mode Timing Diagram
Table 63. Slave Serial Configuration Mode Timing Characteristics
OR3Cxx Commercial: VDD = 5.0 V ± 5%, 0 °C
< TA < 70 °C; Industrial: VDD = 5.0 V ± 10%, –40 °C < TA < +85 °C.
OR3Txxx Commercial: VDD = 3.0 V to 3.6 V, 0 °C
< TA < 70 °C; Industrial: VDD = 3.0 V to 3.6 V, –40 °C < TA < +85 °C.
Parameter
Symbol
Min
Max
Unit
DIN Setup Time
TS
20.00
—
ns
DIN Hold Time
TH
0.00
—
ns
CCLK High Time
TCH
20.00
—
ns
CCLK Low Time
TCL
20.00
—
ns
CCLK Frequency
FC
—
25.00
MHz
CCLK to DOUT
TD
—
20.00
ns
5-4535(F)
DIN
CCLK
DOUT
TD
TS
TH
TCL
TCH
BIT N
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