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参数资料
| 型号： | PCF51JM64EVLK |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 19/49页 |
| 文件大小： | 0K |
| 描述： | MCU 32BIT 64K FLASH 80-LQFP |
| 标准包装： | 90 |
| 系列： | MCF51JM |
| 核心处理器： | Coldfire V1 |
| 芯体尺寸： | 32-位 |
| 速度： | 50MHz |
| 连通性： | CAN，I²C，SCI，SPI，USB OTG |
| 外围设备： | LVD，PWM，WDT |
| 输入/输出数： | 66 |
| 程序存储器容量： | 64KB（64K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 16K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 12x12b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 80-LQFP |
| 包装： | 托盘 |
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MCF51JM128 ColdFire Microcontroller, Rev. 4
Preliminary Electrical Characteristics
Freescale Semiconductor
26
2.9
External Oscillator (XOSC) Characteristics
Table 15. Oscillator Electrical Specifications (Temperature Range = –40 to 105
C Ambient)
Num
C
Rating
Symbol
Min
Typ1
1 Data in Typical column was characterized at 5.0 V, 25
C or is typical recommended value.
Max
Unit
1
Oscillator crystal or resonator (EREFS = 1, ERCLKEN = 1)
Low range (RANGE = 0)
High range (RANGE = 1) FEE or FBE mode 2
High range (RANGE = 1) PEE or PBE mode 3
High range (RANGE = 1, HGO = 1) BLPE mode
High range (RANGE = 1, HGO = 0) BLPE mode
2 When MCG is configured for FEE or FBE mode, input clock source must be divisible using RDIV to within the range of 31.25 kHz
to 39.0625 kHz.
3 When MCG is configured for PEE or PBE mode, input clock source must be divisible using RDIV to within the range of 1 MHz
to 2 MHz.
flo
fhi-fll
fhi-pll
fhi-hgo
fhi-lp
32
1
—
38.4
5
16
8
kHz
MHz
2
Load capacitors
C1
C2
See crystal or resonator
manufacturer’s recommendation.
3
Feedback resistor
Low range (32 kHz to 38.4 kHz)
High range (1 MHz to 16 MHz)
RF
10
1
M
M
4—
Series resistor
Low range, low gain (RANGE = 0, HGO = 0)
Low range, high gain (RANGE = 0, HGO = 1)
8MHz
4MHz
MHz
High range, low gain (RANGE = 1, HGO = 0)
High range, high gain (RANGE = 1, HGO = 1)
8MHz
4MHz
MHz
RS
—
0
100
0
—
0
10
20
k
5T
Crystal start-up time 4
Low range, low gain (RANGE = 0, HGO = 0)
Low range, high gain (RANGE = 0, HGO = 1)
High range, low gain (RANGE = 1, HG0 = 0)5
High range, high gain (RANGE = 1, HG0 = 1)5
4 This parameter is characterized and not tested on each device. Proper PC board-layout procedures must be followed to achieve
specifications.
5 4 MHz crystal
t
CSTL-LP
t
CSTL-HGO
t
CSTH-LP
t
CSTH-HGO
—
200
400
5
15
—
ms
6T
Square wave input clock frequency (EREFS = 0, ERCLKEN = 1)
FEE or FBE mode 2
PEE or PBE mode 3
BLPE mode
fextal
0.03125
1
0
—
5
16
40
MHz
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