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参数资料
| 型号： | PEF22554E |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 通信及网络 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件页数： | 7/30页 |
| 文件大小： | 914K |
| 代理商： | PEF22554E |
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QuadFALC
PEF 22554
Overview
Delta Sheet
7/30
2002-09-16
1.7
Pin Description
A short pin list of the BGA package is given in
Table 2
. For a complete signal description
refer to the QuadFALC
V2.1 Preliminary Data Sheet.
Table 1
Additional Pin Functions
Voltage Select
Enables the internal voltage regulator for 3.3 V-only operation
mode if connected to
V
DD
(recommended) or left open.
Disables the internal voltage regulator for dual power supply mode
if connected to
V
SS
.
Positive Power Supply
for the digital core (1.8 V)
These pins can either be positive power supply input or output
depending on the VSEL input condition.
If the VSEL pin is connected to
V
SS
, these pins are inputs and
must both be connected to the same 1.8 V power supply and
require decoupling.
If the VSEL pin is connected to
V
DD
(3.3 V), these pins will both be
1.8 V power supply outputs and must be decoupled to
V
SS
.
Attention: These pins must not be used to supply external
devices.
Positive Power Supply
for the analog PLL (3.3 V)
Power Supply Ground
for the analog PLL (0 V)
VSEL
I + PU
V
DDC
S
V
DDP
V
SSP
S
S
Table 2
Ball No.
BGA
BGA Pin Assignment
Pin No.
TQFP
Symbol
Input(I)
Output(O)
Supply(S)
I + PU
I + PU
I + PU
I + PU
I + PU
I + PU
I + PU
I + PU
Function
N12
M12
L13
L12
L14
L11
K13
K14
74
75
76
77
78
79
80
81
A0
A1
A2
A3
A4
A5
A6
A7
Address Bus
Address Bus
Address Bus
Address Bus
Address Bus
Address Bus
Address Bus
Address Bus
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